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本公开涉及无滤波的数字锁相环。在一个例子中公开一种适用于避免环路带宽权衡的数字锁相环(DPLL)电路，该电路包括：频率维度频率检测器，具有外部频率输入和反馈频率输入，所述频率维度频率检测器包括测量所述外部频率输入和所述反馈频率输入之间的频率...
该专利属于美国亚德诺半导体公司所有，仅供学习研究参考，未经过美国亚德诺半导体公司授权不得商用。

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