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本发明公开一种记录数字逻辑设计工程工作状态的方法及系统，涉及数字逻辑设计技术领域；利用记录电路在数字逻辑设计文件中使用特定标记标记设计工程中需要记录的信号，利用记录模块读取数字逻辑设计文件，检索设计工程，找到特定标记，根据被标记的信号的属性...
该专利属于山东浪潮人工智能研究院有限公司所有，仅供学习研究参考，未经过山东浪潮人工智能研究院有限公司授权不得商用。

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