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应用于CMOS制程中的静电放电保护元件结构制造技术
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文档序号:21550626
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本发明公开了一种应用于CMOS制程中的静电放电保护元件结构,其中输入/输出电路的电源输入/输出单元或者是与信号输入/输出单元之间电性连接有静电放电箝制电路,并于静电放电箝制电路的P型基底上形成有多个串联连接的低电压PMOS结构,且第一个低电...
该专利属于禾瑞亚科技股份有限公司所有,仅供学习研究参考,未经过禾瑞亚科技股份有限公司授权不得商用。
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