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本发明提出一种极化码译码中路径分裂的硬件排序器系统及设计方法，实施本发明的有益效果是，在极化码译码过程中，对固定比特位的路径不需要排序，因此节省了固定比特位的排序时间；另外只需要在信息比特位进行排序，其排序器的延迟时间与输入的路径数量基本无...
该专利属于中国地质大学（武汉）所有，仅供学习研究参考，未经过中国地质大学（武汉）授权不得商用。

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