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本发明公开了一种片内容错存储的复用结构及方法，包括总线，总线通过总线接口连接至片内存储容错控制器，片内存储容错控制器输出端连接有第一地址译码器和第二地址译码器，第一地址译码器的输出端连接有片内存储区，第二地址译码器的输出端通过拼接逻辑连接至...
该专利属于西安微电子技术研究所所有，仅供学习研究参考，未经过西安微电子技术研究所授权不得商用。

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