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本实用新型公开了一种基于FPGA的两通道数据分类同步输出电路，包括数据接收模块、片上数据存储RAM模块、数据分类控制模块和数据输出模块，所述数据接收模块连接片上数据存储RAM模块和数据分类控制模块，数据分类控制模块中的锁相环输出的读写时钟提...
该专利属于兰州大学所有，仅供学习研究参考，未经过兰州大学授权不得商用。

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