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一种可配置多码长、多码率的低密度奇偶校验码LDPC译码器，该译码器包括三层结构，顶层模块包括存储输入软信息单元，存储输出软信息单元，存储校验和单元，译码控制单元，宏定义单元，核心译码单元；核心译码层模块包括初始化单元，迭代控制单元，变量信息...
该专利属于西安电子科技大学所有，仅供学习研究参考，未经过西安电子科技大学授权不得商用。

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