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本发明公开了一种基于PLL时钟模块的直流电压控制电路，由时钟生成电路、PLL时钟模块电路、脉宽发生电路和或选通电路组成。时钟生成电路对输入时钟信号倍频后输出基础时钟信号至PLL时钟模块电路；脉宽发生电路在零时延时钟的控制下输出粗调脉宽信号至...
该专利属于南京理工大学所有，仅供学习研究参考，未经过南京理工大学授权不得商用。

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