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本发明涉及一种用于锁存防止的自适应体偏置电路。本文揭示用于减少或防止在行解码器电路中锁存的技术及方法。一种实例设备可包含像素阵列、行地址解码器及控制电路。所述行解码电路包含多个解码电路，其各自包含至少两个具有耦合到第一节点的相应体端子的晶体...
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