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本发明涉及一种具备帧对齐功能的高速串并转换电路，能够实现高速串行数据到并行数据的转换，电路主体包括三个模块：时钟管理模块，可以产生各种相位的时钟，用于串行数据采样及解串模块和帧对齐模块；串行数据采样及解串模块，对串行数据进行采样，利用时钟管...
该专利属于中国电子科技集团公司第五十八研究所所有，仅供学习研究参考，未经过中国电子科技集团公司第五十八研究所授权不得商用。

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