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本发明公开了一种应用于静态随机存储器的锁存型流水结构高速地址译码器，能够消除预译码模块造成的译码时间损耗，同时其第二级译码模块采用本发明中提出的受时钟控制的新型译码电路结构能够有效的提高第二级译码模块的译码速度，进而提高整个地址译码器的性能...
该专利属于安徽大学所有，仅供学习研究参考，未经过安徽大学授权不得商用。

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