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本发明提供了一种时序修正方法，包括：根据网表文件、第一时序约束文件以及寄生参数文件进行静态时序分析以产生第一标准延迟文件和日志文件；透过第一脚本，根据所述日志文件判断是否发生设计规则违例；当判断所述设计规则违例发生时，透过所述第一脚本，产生...
该专利属于上海兆芯集成电路有限公司所有，仅供学习研究参考，未经过上海兆芯集成电路有限公司授权不得商用。

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