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本实用新型公开了一种基于可逆逻辑的8421BCD码同步十进制加/减法计数器，包括4个基于可逆逻辑构造的可逆主从JK触发器及5个过渡模块，该4个可逆主从JK触发器及5个过渡模块按照各个输入端、输出端间的相互引用关系进行级联，同时将各个可逆主从...
该专利属于桂林电子科技大学所有，仅供学习研究参考，未经过桂林电子科技大学授权不得商用。

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