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本发明提供一种降低差分串扰的PCB走线设计方法,芯片差分引脚焊盘和差分对layout耦合走线时,芯片引脚的耦合极性与差分线对的耦合极性相反,其各自对应产生的串扰噪声极性也相反,这样,噪声信号叠加时,由于幅度极性相反,势必大部分噪声能量相互叠...该专利属于浪潮电子信息产业股份有限公司所有,仅供学习研究参考,未经过浪潮电子信息产业股份有限公司授权不得商用。
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本发明提供一种降低差分串扰的PCB走线设计方法,芯片差分引脚焊盘和差分对layout耦合走线时,芯片引脚的耦合极性与差分线对的耦合极性相反,其各自对应产生的串扰噪声极性也相反,这样,噪声信号叠加时,由于幅度极性相反,势必大部分噪声能量相互叠...