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本实用新型公开了一种具有记忆功能背景抑制结构的读出电路，该电路通过采用具有记忆功能的背景抑制电路模块，首先将2×2排列的四个像元背景电流的平均电流进行复制记忆，然后将这个电流作为四个像元的背景电流从光电流中减去，最后通过使用高增益共享式负反...该专利属于中国科学院上海技术物理研究所所有，仅供学习研究参考，未经过中国科学院上海技术物理研究所授权不得商用。
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本实用新型公开了一种具有记忆功能背景抑制结构的读出电路，该电路通过采用具有记忆功能的背景抑制电路模块，首先将2×2排列的四个像元背景电流的平均电流进行复制记忆，然后将这个电流作为四个像元的背景电流从光电流中减去，最后通过使用高增益共享式负反...