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本发明公开了一种60Hz通信系统中FFT处理器的重排序模块，其具体包括：第一路径选择器、RAM模块、第二路径选择器以及控制模块，所述第一路径选择器的输入端用于输入8路并行的FFT处理器运算结果，RAM模块的输入端与第一路径选择器的输出端相连...
该专利属于电子科技大学所有，仅供学习研究参考，未经过电子科技大学授权不得商用。

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