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静态随机存取存储器访问系统技术方案

技术编号:41011628 阅读:28 留言:0更新日期:2024-04-18 21:47
本发明专利技术涉及存储器访问技术领域,公开了一种静态随机存取存储器访问系统,其特征在于,包括:多个总线接口、控制单元、控制命令缓存区、静态随机存取存储器,总线接口用于连接主机,接收主机发送的读写传输任务,一个总线接口支持连接一个主机;控制命令缓存区用于存储读写传输任务;控制单元用于提取控制命令缓存区中一个或多个读写传输任务,在静态随机存取存储器的端口空闲时执行读写传输任务。本发明专利技术支持主机可以并发向系统发送任务,并且,控制单元可以对控制命令缓存区中的多个读写传输任务时进行综合统筹处理,进一步提高了对读写传输任务的响应效率。

【技术实现步骤摘要】

本专利技术涉及存储器访问,具体涉及静态随机存取存储器访问系统


技术介绍

1、随着计算机技术的飞速发展,存储设备成本的降低,大数据、云计算等存储数据量和系统复杂程度大大增加,因此,目前也越来越追求对存储设备进行高效而灵活的访问。现有技术中,对于静态随机存取存储器(static random-access memory,sram)的访问主要分为两种方式,一种是使用单端口的sram,一种是使用双端口的sram。对于单端口的静态随机存取存储器sram,若复杂多任务系统需要对该sram进行访问,多个主机同时向sram发起任务后,sram无法同时对多个任务进行处理,因此单端口sram无法对多复杂任务系统发起的任务进行高效处理。若使用双端口的sram,虽然支持读写任务并发,能够提高读写效率,但是双端口的sram面积较大,使得芯片的制造成本大大增加。


技术实现思路

1、有鉴于此,本专利技术提供了一种静态随机存取存储器访问系统,以解决无法对单端口sram进行高效访问的问题。

2、本专利技术提供了一种静态随机存取存储器访问系统,包括:多个总线接口、控制单元、控制命令缓存区、静态随机存取存储器,总线接口用于连接主机,接收主机发送的读写传输任务,一个总线接口支持连接一个主机;控制命令缓存区用于存储读写传输任务;控制单元用于提取控制命令缓存区中一个或多个读写传输任务,在静态随机存取存储器的端口空闲时执行读写传输任务。

3、本专利技术实施例提供的静态随机存取存储器访问系统,通过多个总线接口连接多个主机,多个主机可以并发向系统发送任务,并且,本专利技术实施例提供的系统中还包括控制命令缓存区,通过控制命令缓存区缓存总线接口接收的读写传输任务,控制单元执行控制命令缓存区中的读写传输命令,可以保证总线接口接收到的所有读写传输任务被执行,避免主机发起的读写传输任务被遗漏。又由于控制单元可以对控制命令缓存区中的多个读写传输任务时进行综合统筹处理,进一步提高了对读写传输任务的响应效率。

4、在一种可选的实施方式中,本专利技术实施例提供的系统还包括写数据缓存区,写数据缓存区用于存储写传输任务的写数据;控制单元执行写传输任务时,从写数据缓存区中提取与写传输任务对应的写数据,按照写传输任务将写数据写入静态随机存取寄存器。

5、在一种可选的实施方式中,本专利技术实施例提供的系统中,写数据缓存区的数量与总线接口的数量相同,各写数据缓存区分别对应一个总线接口,用于存储相应总线接口接收的写数据。

6、本专利技术实施例中,将不同总线接口接收到的写数据写入对应的写数据缓存区,控制单元在执行不同总线接口接收到的写数据传输任务时,可以从该总线接口对应的写数据缓存区中提取写数据,提高了写数据的提取速度,也能尽可能减少提取过程中出现错误。

7、在一种可选的实施方式中,读写的传输任务中包含总线访问地址,若控制单元获取到读传输任务和写传输任务,读传输任务和写传输任务中包含相同的总线访问地址,控制单元从写数据缓存区中获取与写传输任务对应的写数据;将写数据发送至读传输任务对应的总线接口;将总线访问地址译码为存储地址,存储地址的格式与静态随机存取存储器的地址格式相同;将写数据译码为待写入数据,待写入数据的格式与静态随机存取存储器的存储格式相同;在静态随机存取存储器的端口空闲时,将待写入数据写入存储地址。

8、本专利技术实施例中,通过多个总线接口可以实现并发接收多个读写传输任务,当同时接收到总线访问地址相同的读传输任务和写传输任务时,直接将写传输任务对应的写数据发送至读传输任务对应的总线接口即可,即,在执行读传输任务时不需要访问sram,只需要将写数据写入sram时访问sram即可,提到了任务执行效率。

9、在一种可选的实施方式中,若控制单元获取到多个总线访问地址相同的写传输任务,控制单元从写数据缓存区中提取分别与各写传输任务对应的写数据;将总线访问地址译码为存储地址,存储地址的格式与静态随机存取存储器的地址格式相同;将各写数据译码各写数据分别对应的待写入数据,待写入数据的格式与静态随机存取存储器的存储格式相同;在静态随机存取存储器的端口空闲时,按照各写传输任务的执行顺序,依次将各写传输任务对应的待写入数据写入存储地址,各写传输任务的执行顺序是根据发送各写传输任务的主机的优先级确定的。

10、在一种可选的实施方式中,若控制单元获取到多个总线访问地址相同的读传输任务,控制单元将总线访问地址译码为存储地址,存储地址的格式与静态随机存取存储器的地址格式相同;在静态随机存取存储器的端口空闲时,读取静态随机存取存储器中位于存储地址的目标数据;按照各读传输任务的执行顺序,将目标数据分别发送至各读传输任务分别对应的总线接口,各读传输任务的执行顺序是根据发送各读传输任务的主机的优先级确定的。

11、在本专利技术实施例中,控制单元同时获取到多个总线访问地址相同的读传输任务时,只需要访问一次sram即可实现对多个主机的反馈,提高了任务执行效率。

12、在一种可选的实施方式中,系统中包括第一总线接口、第二总线接口、第一写数据缓存区、第二写数据缓存区,第一总线接口连接第一主机,第二总线接口连接第二主机,第一写数据缓存区用于接收第一总线接口接收的写数据,第二写数据缓存区用于接收第二总线接口接收的写数据,第一总线接口接收第一主机发送的第一读写传输任务,第一读写传输任务中包含第一读传输任务和第一写传输任务;第二总线接口接收第二主机发送的第二读写传输任务,第二读写传输任务中包含第二读传输任务和第二写传输任务;控制单元将第一写传输任务对应的第一写数据写入第一写数据缓存区,将第二写传输任务对应的第二写数据写入第二写数据缓存区;控制单元将第一读传输任务中的第一总线访问地址译码为第一存储地址,若第一存储地址位于第一访问区域内,在静态随机存取存储器的端口空闲时,读取静态随机存取存储器中位于第一存储地址的第一目标数据,将第一目标数据发送至第一总线接口;第一存储地址的格式与静态随机存取存储器的地址格式相同,第一访问区域为预先设定的第一主机可访问的区域;控制单元将第二读传输任务中的第二总线访问地址译码为第二存储地址,若第二存储地址位于第二访问区域内,在静态随机存取存储器的端口空闲时,读取静态随机存取存储器中位于第二存储地址的第二目标数据,将第二目标数据发送至第二总线接口;第二存储地址的格式与静态随机存取存储器的地址格式相同,第二访问区域为预先设定的第二主机可访问的区域;控制单元从第一写数据缓存区中提取第一写数据;将第一写传输任务中的第三总线访问地址译码为第三存储地址,将第一写数据译码为第一待写入数据,在静态随机存取存储器的端口空闲时,将第一待写入数据写入第三存储地址;第三存储地址的格式与静态随机存取存储器的地址格式相同,第一待写入数据的格式与静态随机存取存储器的存储格式相同;控制单元从第二写数据缓存区中提取第二写数据;将第二写传输任务中的第四总线访问地址译码为第四存储地址,将第二写数据译码为第二待写入数据,在静态随机存取存储器的端口空闲时,将本文档来自技高网...

【技术保护点】

1.一种静态随机存取存储器访问系统,其特征在于,包括:多个总线接口、控制单元、控制命令缓存区、静态随机存取存储器,

2.根据权利要求1所述的系统,其特征在于,还包括写数据缓存区,

3.根据权利要求2所述的系统,其特征在于,

4.根据权利要求2所述的系统,其特征在于,所述读写的传输任务中包含总线访问地址,

5.根据权利要求2所述的系统,其特征在于,

6.根据权利要求1所述的系统,其特征在于,

7.根据权利要求3所述的系统,其特征在于,所述系统中包括第一总线接口、第二总线接口、第一写数据缓存区、第二写数据缓存区,所述第一总线接口连接第一主机,所述第二总线接口连接第二主机,所述第一写数据缓存区用于接收所述第一总线接口接收的写数据,所述第二写数据缓存区用于接收所述第二总线接口接收的写数据,

8.根据权利要求5或6所述的系统,其特征在于,所述系统还包括:

9.根据权利要求7所述的系统,其特征在于,所述系统还包括:

10.根据权利要求1所述的系统,其特征在于,所述系统还包括:

【技术特征摘要】

1.一种静态随机存取存储器访问系统,其特征在于,包括:多个总线接口、控制单元、控制命令缓存区、静态随机存取存储器,

2.根据权利要求1所述的系统,其特征在于,还包括写数据缓存区,

3.根据权利要求2所述的系统,其特征在于,

4.根据权利要求2所述的系统,其特征在于,所述读写的传输任务中包含总线访问地址,

5.根据权利要求2所述的系统,其特征在于,

6.根据权利要求1所述的系统,其特征在于,

7.根据权利要求3所述的系...

【专利技术属性】
技术研发人员:尹悦邢宗岐牛少平张赫男
申请(专利权)人:山东云海国创云计算装备产业创新中心有限公司
类型:发明
国别省市:

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