【技术实现步骤摘要】
本专利技术涉及频率合成，尤其涉及一种锁相环电路及其控制方法。
技术介绍
1、在频率合成技术中，锁相环(phase-locked loop，pll)可以将参考时钟信号的频率乘以对应量以生成具有期望频率的信号。在无线通信系统、微处理系统和高速数据系统中，pll用于提供具有期望频率的信号。
2、目前，随着物联网应用对超低功耗和超低面积的需求高，对锁相环的要求也随之提高。现有的锁相环电路中，通常是利用采样脉冲发生器产生的非交叠时钟来控制锁相环进入锁定模式，但采用此种方案产生的非交叠时钟会恶化时钟性能，难以实现超低功耗的锁相环结构。
技术实现思路
1、本专利技术的目的在于提供一种锁相环电路及其控制方法，用于实现高性能的非交叠时钟信号，以在提高锁相环的频率精度时，降低锁相环的功耗。
2、为了实现上述目的，本专利技术提供如下技术方案：
3、第一方面，本专利技术提供一种锁相环电路，包括：电连接的数字控制子电路以及模拟子电路，模拟子电路包括依次电连接的积分模块、压控振荡器和反馈分频模块。反馈分频模块用于，基于压控振荡器的输出信号生成非交叠时钟信号。积分模块用于，基于非交叠时钟信号进行积分路径的信号处理生成积分时钟信号。压控振荡器用于，对积分时钟信号进行信号处理生成目标频率的当前输出信号。数字控制子电路用于，基于当前输出信号控制模拟子电路处于目标锁定状态。
4、与现有技术相比，本专利技术提供的锁相环电路中，在模拟子电路中，反馈分频模块可以对压控振荡器的输
5、第二方面，本专利技术还提供一种锁相环电路的控制方法，应用于上述第一方面技术方案所述的锁相环电路，控制方法包括：
6、控制反馈分频模块基于压控振荡器的输出信号生成非交叠时钟信号。控制积分模块基于非交叠时钟信号进行积分路径的信号处理生成积分时钟信号。控制压控振荡器对积分时钟信号进行信号处理生成目标频率的当前输出信号。控制数字控制子电路基于当前输出信号控制模拟子电路处于目标锁定状态。
7、与现有技术相比，本专利技术提供的锁相环电路的控制方法的有益效果与上述技术方案所述锁相环电路的有益效果相同，此处不做赘述。
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1.一种锁相环电路，其特征在于，包括：电连接的数字控制子电路以及模拟子电路，所述模拟子电路包括依次电连接的积分模块、压控振荡器和反馈分频模块；
2.根据权利要求1所述的锁相环电路，其特征在于，所述反馈分频模块包括电连接的异步计数子模块、周期结束检测子模块以及逻辑子模块，其中：
3.根据权利要求2所述的锁相环电路，其特征在于，所述周期结束检测子模块包括分别与所述异步计数子模块电连接的第一周期结束检测单元、第二周期结束检测单元以及第三周期结束检测单元，所述逻辑子模块包括第一逻辑单元、第二逻辑单元以及第三逻辑单元，所述非交叠时钟信号包括第一非交叠时钟信号和第二非交叠时钟信号，其中：
4.根据权利要求3所述的锁相环电路，其特征在于，所述异步计数子模块包括多个级联的D触发器。
5.根据权利要求1所述的锁相环电路，其特征在于，所述积分模块包括电连接的时钟发生器和积分器，所述反馈分频模块的输出端分别与所述积分器的输入端和所述时钟发生器的输出端电连接；
6.根据权利要求5所述的锁相环电路，其特征在于，所述积分器包括依次电连接的数据选择单
7.根据权利要求6所述的锁相环电路，其特征在于，所述第一积分单元包括第一传输门和第一积分电容，所述第二积分单元包括第二传输门和第二积分电容，其中：
8.根据权利要求1所述的锁相环电路，其特征在于，所述锁相环电路还包括鉴相模块，其中：
9.根据权利要求8所述的锁相环电路，其特征在于，所述鉴相模块包括鉴频鉴相器和二进制鉴相器；
10.一种锁相环电路的控制方法，其特征在于，应用于权利要求1～9任一项所述的锁相环电路，所述控制方法包括：
...【技术特征摘要】
1.一种锁相环电路，其特征在于，包括：电连接的数字控制子电路以及模拟子电路，所述模拟子电路包括依次电连接的积分模块、压控振荡器和反馈分频模块；
2.根据权利要求1所述的锁相环电路，其特征在于，所述反馈分频模块包括电连接的异步计数子模块、周期结束检测子模块以及逻辑子模块，其中：
3.根据权利要求2所述的锁相环电路，其特征在于，所述周期结束检测子模块包括分别与所述异步计数子模块电连接的第一周期结束检测单元、第二周期结束检测单元以及第三周期结束检测单元，所述逻辑子模块包括第一逻辑单元、第二逻辑单元以及第三逻辑单元，所述非交叠时钟信号包括第一非交叠时钟信号和第二非交叠时钟信号，其中：
4.根据权利要求3所述的锁相环电路，其特征在于，所述异步计数子模块包括多个级联的d触发器。
5.根据权利要求1所述的锁相环电路...
【专利技术属性】
技术研发人员：陈东海，邢宸，黄勇，金香菊，
申请(专利权)人：成都爱旗科技有限公司，
类型：发明
国别省市：
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