实现ＩＲＩＧ－Ｂ信号解码校时的方法技术

本发明专利技术涉及一种基于ＣＰＣＩ总线的ＩＲＩＧ－Ｂ信号解码校时卡装置实现ＩＲＩＧ－Ｂ信号解码校时的方法，包括接收Ｂ码信号、对Ｂ码信号进行脉宽检测解码得到校时信息、将校时信息送至ＣＰＣＩ总线上的远端设备进行时间同步校正。采用该种基于ＣＰＣＩ总线的ＩＲＩＧ－Ｂ信号解码校时卡装置实现ＩＲＩＧ－Ｂ信号解码校时的方法，有效保证了微机装置本地时钟同步，并将彼此误差控制在０．０１ｍｓ以内，结构简单实用，工作过程快捷高效，工作性能稳定可靠，适用范围较广，适用于变电站自动化通信系统。

【技术实现步骤摘要】

本专利技术涉及嵌入式计算机平台领域，特别涉及嵌入式计算机分布式系统校时技术 领域，具体是指一种基于CPCI总线的IRIG-B信号解码校时卡装置及其方法。
技术介绍
电力系统通常采用事件顺序(SOE，Sequence Of Event)来确定电力故障的先后， 进行电力系统故障推理分析的依据，SOE时间的正确性直接会影响到故障分析的结果。产生这些SOE的正是诸如测控装置、微机保护装置、故障录波装置、PMU装置、小 电流选线装置、消弧线圈自动装置、AVQC装置、状态监测装置、直流绝缘监测装置等信息采 集控制的微机装置，这些微机装置根据自身的不同原理和特点分别成为监控系统、继电保 护故障信息分析系统、状态在线监测分析系统、WAMAP系统等电力生产调度、电力运行维护 分析、电力故障分析、电力故障预测分析的基本单元。只有保证微机装置的系统时钟的正确，才能保证事件记录的时间的正确可用，所 以各微机装置的时钟同步问题就显得十分重要。目前在现有技术中，常规的微机装置产品基本上采用脉冲方式(PPM、PPS)，该方式 简单实用，但需要外部补充年、月、日、时、分、秒的时间信息，如果与主站配合不好，会带来 很大的误差，给电力系统故障分析带来很大的困难，无法体现GPS的优越性。IRIG(Inter-Range Instrumentation Group)是美国靶场司令部委员会的下属机 构，称为“靶场时间组”。IRIG时间标准有两大类(1) 一类是并行时间码格式，这类码由于是并行格式，传输距离较近，且是二进制， 因此远不如串行格式广泛；(2)另一类是串行时间码，共有六种格式，即A、B、D、E、G、H。它们的主要差别是时间码的帧速率不同。B码的主要特点是时帧速率为1帧/s ； 携带信息量大，经译码后可获得l、10、100、1000c/s的脉冲信号和BCD编码的时间信息及控 制功能信息；高分辨率；调制后的B码带宽，适用于远距离传输；分直流、交流两种；具有接 口标准化，国际通用。IRIG-B(DC)时间码格式是常规的公知技术，请参阅图1所示，其帧速 率为1帧/s，可将1帧(Is)分为10个字，每字为10位，每位的周期均为10ms。每位都以 高电平开始，其持续时间分为3种类型2ms (如二进制“0”码和索引标志)、5ms (如二进制 “1”码)和8ms (如参考码元，即每秒开始的第一字的第一位；位置标志PO P9，即每个字 的第十位)。第一个字传送的是秒(s)信息，第二个字是分(min)信息，第三个字是时(h) 信息，第四、五个字是日(d)(从1月1日开始计算的年积日)。另外，在第八个字和第十个 字中分别有3位表示上站和分站的特标句柄元。由此可见要对IRIG-B信号进行解码并识别必须进行脉宽检测，在目前的技术方案中还没有一种完整的实现方案，另外要将IRIG-B解码数据送给主CPU，还要通过CPCI总 线进行传送。CPCI (压缩PCI，CompactPCI)是计算机PCI总线在嵌入式领域的扩展，硬件结构 改金手指板卡连接为IEC 2mm高密度针孔连接，总线规范规定了背板上各插槽之间，系统 槽与背板，I/O模板与背板之间严格的互连关系，定义了背板、模板和前后面板的结构和尺 寸。定义Pl支持32位PCI操作，Pl和P2支持64位PCI操作，P3、P4和P5留给用户使用 或作为总线扩展用。规范还为33MHz和66MHz工作频率的Clock信号分布，定义了严格的 设计规则。规范还定义了系统管理总线，并为背板上每个插槽定义了唯一对应的物理地址。 CPCI系统由金属外壳和前、后面板组成的整体导电以及电路设计，使得CPCI具有电磁辐射 屏蔽和静电释放能力，表现出良好的电磁兼容性。因此CPCI (Compact PCI)总线嵌入式计 算机在工业生产领域表现出极高的安全可靠性。
技术实现思路
本专利技术的目的是克服了上述现有技术中的缺点，提供一种能够将各微机装置的本 地时钟保持同步、有效控制时钟误差、结构简单实用、工作性能稳定可靠、适用范围较为广 泛的基于CPCI总线的IRIG-B信号解码校时卡装置及其方法。为了实现上述的目的，本专利技术的基于CPCI总线的IRIG-B信号解码校时卡装置及 其方法如下该基于CPCI总线的IRIG-B信号解码校时卡装置，其主要特点是，所述的装置包括 CPCI接口模块、中央解码控制模块、B码信号磁隔离输入模块、显示输出模块和电源模块， 所述的电源模块与其它各个模块均相连接，所述的B码信号磁隔离输入模块通过所述的中 央解码控制模块与所述的显示输出模块相连接，所述的中央解码控制模块通过所述的CPCI 接口模块接入主机系统的CPCI总线。该基于CPCI总线的IRIG-B信号解码校时卡装置中的中央解码控制模块包括中央 控制单元和B码信号解码单元，所述的B码信号解码单元与所述的中央控制单元相连接。该基于CPCI总线的IRIG-B信号解码校时卡装置中的B码信号磁隔离输入模块包 括TTL信号磁隔离输入单元、RS485信号接收磁隔离输入单元和模数转换磁隔离输入单元， 所述的TTL信号磁隔离输入单元、RS485信号接收磁隔离输入单元和模数转换磁隔离输入 单元均与所述的中央解码控制模块相连接。该基于CPCI总线的IRIG-B信号解码校时卡装置中的显示输出模块包括LED显 示单元和控制信号磁隔离输出单元，所述的LED显示单元与所述的中央解码控制模块相连 接，且该中央解码控制模块通过所述的控制信号磁隔离输出单元与报警继电器相连接。该基于上述的装置实现IRIG-B信号解码校时的方法，其主要特点是，所述的方法 包括以下步骤(1)所述的装置插入主机系统的CPCI接口槽，主机系统为该装置分配系统资源；(2)所述的B码信号磁隔离输入模块接收外界的B码信号；(3)所述的B码信号磁隔离输入模块将接收到的B码信号送入所述的中央解码控 制模块中；(4)所述的中央解码控制模块对该B码信号进行脉宽检测解码处理，并得到相应4的校时信息；(5)所述的中央解码控制模块根据所得到的校时信息向显示输出模块发送输出控 制信息；(6)所述的中央解码控制模块将该校时信息通过所述的CPCI接口模块送至CPCI 总线上所接入的远端设备，所述的远端设备根据该校时信息进行时间同步校正处理。该实现IRIG-B信号解码校时的方法中的脉宽检测解码处理，包括以下步骤(11)所述中央解码控制模块读取B码信号中的码元；(12)判断该码元的码元值的范围；(13)如果该码元值落入1900 2100区间，则置接收比特位为0 ；(14)如果该码元值落入4900 5100区间，则置接收比特位为1 ；(15)如果该码元值落入7900 8100区间，则设置接收比特位置标志P ；(16)否则将计数器清零，并将脉宽计数值清零，返回上述步骤(11)；(17)将计数器的值增加1 ；(18)判断计数器的值是否大于100 ；(19)如果是，则将计数器清零，向主机系统发送出错中断，并将脉宽计数值清零， 返回上述步骤(11)；(20)如果否，则判断该接收比特位置标志P是否正确；(21)如果正确，则根据B码信号中的时间信息产生校时信息，并将脉宽计数值清 零，返回上述步骤(11)；(22)如果不正确，则将计数器清零，并将脉宽计数值清零，返回本文档来自技高网...

【技术保护点】
一种基于ＣＰＣＩ总线的ＩＲＩＧ－Ｂ信号解码校时卡装置实现ＩＲＩＧ－Ｂ信号解码校时的方法，所述的装置包括ＣＰＣＩ接口模块、中央解码控制模块、Ｂ码信号磁隔离输入模块、显示输出模块和电源模块，所述的电源模块与其它各个模块均相连接，所述的Ｂ码信号磁隔离输入模块通过所述的中央解码控制模块与所述的显示输出模块相连接，所述的中央解码控制模块通过所述的ＣＰＣＩ接口模块接入主机系统的ＣＰＣＩ总线，其特征在于，所述的方法包括以下步骤：（１）所述的装置插入主机系统的ＣＰＣＩ接口槽，主机系统为该装置分配系统资源；（２）所述的Ｂ码信号磁隔离输入模块接收外界的Ｂ码信号；（３）所述的Ｂ码信号磁隔离输入模块将接收到的Ｂ码信号送入所述的中央解码控制模块中；（４）所述的中央解码控制模块对该Ｂ码信号进行脉宽检测解码处理，并得到相应的校时信息，所述的脉宽检测解码处理，包括以下步骤：（ａ）所述中央解码控制模块读取Ｂ码信号中的码元；（ｂ）判断该码元的码元值的范围；（ｃ）如果该码元值落入１９００～２１００区间，则置接收比特位为０；（ｄ）如果该码元值落入４９００～５１００区间，则置接收比特位为１；（ｅ）如果该码元值落入７９００～８１００区间，则设置接收比特位置标志Ｐ；（ｆ）否则将计数器清零，并将脉宽计数值清零，返回上述步骤（ａ）；（ｇ）将计数器的值增加１；（ｈ）判断计数器的值是否大于１００；（ｉ）如果是，则将计数器清零，向主机系统发送出错中断，并将脉宽计数值清零，返回上述步骤（ａ）；（ｊ）如果否，则判断该接收比特位置标志Ｐ是否正确；（ｋ）如果正确，则根据Ｂ码信号中的时间信息产生校时信息，并将脉宽计数值清零，返回上述步骤（ａ）；（ｌ）如果不正确，则将计数器清零，并将脉宽计数值清零，返回上述步骤（ａ）；（ｍ）直到Ｂ码信号中全部码元均处理完毕后结束；（５）所述的中央解码控制模块根据所得到的校时信息向显示输出模块发送输出控制信息；（６）所述的中央解码控制模块将该校时信息通过所述的ＣＰＣＩ接口模块送至ＣＰＣＩ总线上所接入的远端设备，所述的远端设备根据该校时信息进行时间同步校正处理。...

【技术特征摘要】
一种基于CPCI总线的IRIG B信号解码校时卡装置实现IRIG B信号解码校时的方法，所述的装置包括CPCI接口模块、中央解码控制模块、B码信号磁隔离输入模块、显示输出模块和电源模块，所述的电源模块与其它各个模块均相连接，所述的B码信号磁隔离输入模块通过所述的中央解码控制模块与所述的显示输出模块相连接，所述的中央解码控制模块通过所述的CPCI接口模块接入主机系统的CPCI总线，其特征在于，所述的方法包括以下步骤(1)所述的装置插入主机系统的CPCI接口槽，主机系统为该装置分配系统资源；(2)所述的B码信号磁隔离输入模块接收外界的B码信号；(3)所述的B码信号磁隔离输入模块将接收到的B码信号送入所述的中央解码控制模块中；(4)所述的中央解码控制模块对该B码信号进行脉宽检测解码处理，并得到相应的校时信息，所述的脉宽检测解码处理，包括以下步骤(a)所述中央解码控制模块读取B码信号中的码元；(b)判断该码元的码元值的范围；(c)如果该码元值落入1900～2100区间，则置接收比特位为0；(d)如果该码元值落入4900～5100...

【专利技术属性】
技术研发人员：王永刚，岑登青，
申请(专利权)人：上海许继电气有限公司，
类型：发明
国别省市：31[中国|上海]