【技术实现步骤摘要】
本专利技术涉及芯片验证，尤其涉及一种芯片fpga原型验证的目标debug数据获取系统。
技术介绍
1、随着芯片验证技术的不断发展，在fpga原型系统对芯片硬件逻辑进行更全面的验证的需求日益增加，这必然要求调试(debug)方法必须能够有效应对各种复杂场景的问题。fpga原型系统仅能直接获取到输入端口的数据，无法获取到内部信号的变化状况，传统的debug方法应用于fpga原型验证系统时通常只能提供有限的信息，并且仅适用于简单场景的问题。而当芯片硬件逻辑更加复杂，出现的问题难以重现或存在一些上板后的物理特性时，传统的debug方法难以在短时间内获取目标debug数据。由此可知，如何准确快速地获取fpga原型验证系统的目标debug数据成为亟待解决的技术问题。
技术实现思路
1、本专利技术目的在于，提供一种芯片fpga原型验证的目标debug数据获取系统，减少了debug数据所需存储空间，提高了目标debug数据获取的准确性和效率。
2、根据本专利技术一方面，提供了一种芯片fpga原型验证的目标debug数据获取系统，
3、包括软件控制模块、fpga原型验证模块和存储模块，其中，所述软件控制模块分别与fpga原型验证模块和存储模块相连接，所述存储模块与fpga原型验证模块相连接；
4、所述软件控制模块用于通过fpga原型验证模块的输入端口配置fpga原型验证模块的初始状态，以及向fpga原型验证模块的输入端口输入激励数据；
5、所述fpga
6、所述存储模块包括第一存储区域，所述第一存储区域包括n个存储单元(b1,b2,…,bn,…,bn)，bn为第n个存储单元，n的取值范围为1到n，bn的大小大于(x+y)；
7、所述软件控制模块控制将所述fpga原型验证模块的输入端口中所述选择的y个时钟对应的待转存数据以及所述选择的y个时钟数据作为待存储数据，按照b1,b2,…,bn,…,bn的顺序向所述第一存储区域存储所述待存储数据，当向bn中存储所述待存储数据时，先判断bn当前剩余的存储空间是否大于等于(x+y)，若是，则将所述待存储数据存储至bn中，否则，将所述待存储数据存储至bn+1中，当存储至bn且bn中的存储空间小于(x+y)时，将所述待存储数据存储至b1中；
8、当所述fpga原型验证模块运行至目标触发点时，所述软件控制模块基于所述目标触发点获取所述第一存储区域中所存储的数据作为目标debug数据。
9、本专利技术与现有技术相比具有明显的优点和有益效果。借由上述技术方案，本专利技术提供的一种芯片fpga原型验证的目标debug数据获取系统可达到相当的技术进步性及实用性，并具有产业上的广泛利用价值，其至少具有以下有益效果：
10、本专利技术通过循环覆盖的方式在存储模块的第一区域存储的输入端口的输入激励数据以及对应的时钟数据，当运行至目标触发点时，所述软件控制模块基于所述目标触发点获取所述第一存储区域中所存储的数据作为目标debug数据，减少了debug数据所需存储空间，提高了目标debug数据获取的准确性和效率。
本文档来自技高网...【技术保护点】
1.一种芯片FPGA原型验证的目标debug数据获取系统，其特征在于，
2.根据权利要求1所述的系统，其特征在于，
3.根据权利要求1所述的系统，其特征在于，
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9.根据权利要求8所述的系统，其特征在于，
【技术特征摘要】
1.一种芯片fpga原型验证的目标debug数据获取系统，其特征在于，
2.根据权利要求1所述的系统，其特征在于，
3.根据权利要求1所述的系统，其特征在于，
4.根据权利要求1所述的系统，其特征在于，
5.根据...
【专利技术属性】
技术研发人员：罗文涛，郭晨光，王秉文，郭缄威，
申请(专利权)人：成都融见软件科技有限公司，
类型：发明
国别省市：
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