【技术实现步骤摘要】
一种处理器
[0001]本公开概括而言涉及计算设备的领域,更具体而言,涉及一种处理器
。
技术介绍
[0002]随着私密计算
、
加密和安全应用的快速发展,越来越广泛的使用诸如
4096
比特整数加法和乘法之类的大数计算
。
剩余数系统(
Residue Number System
,
RNS
)使用剩余数的集合来表示二进制数
。
通过经由模集中的每个模数将大数转换成一组小的剩余数,
RNS
尤其能够降低加法器和乘法器的进位传递链的长度
。
由于剩余数的无进位特性,可以并行地执行对一组剩余数的计算
。
因此,
RNS
在执行诸如加法
、
减法和乘法之类的大数计算方面比传统二进制数系统性能更加优越
。
与传统的数字表示方法相比,
RNS
提供了低时延
、
以及面积成本以及功耗的降低
。
在第五代精简指令集计算机(
RISC
‑
V
)中,使用
K
扩展来增强加密应用的性能
。K
扩展包括标量
、
向量和熵源指令,然而并未触及大数计算
。
技术实现思路
[0003]本公开的实施例提供了一种处理器
。
该处理器包括:剩余数系统数据寄存器,被配置为存放按照剩余数系 ...
【技术保护点】
【技术特征摘要】
1.
一种处理器,包括:剩余数系统数据寄存器,被配置为存放按照剩余数系统格式表示的数;剩余数系统控制寄存器,耦合到所述剩余数系统数据寄存器,并且被配置为控制所述剩余数系统数据寄存器存放按照剩余数系统格式表示的数的存放方式;以及运算电路,耦合到所述剩余数系统数据寄存器和所述剩余数系统控制寄存器,并且被配置为基于剩余数系统运算指令,根据所述剩余数系统控制寄存器指定的所述存放方式,对存放于所述剩余数系统数据寄存器中的
、
按照剩余数系统格式表示的操作数执行运算
。2.
如权利要求1所述的处理器,其中,所述剩余数系统数据寄存器包括
32
个剩余数系统数据寄存器
。3.
如权利要求2所述的处理器,其中,所述剩余数系统控制寄存器包括四个字节,其中,第一字节
VLEN
表明相关联的硬件的向量长度,第二字节
LMUL
表明要将多少个所述剩余数系统数据寄存器分成一个剩余数系统数据寄存器组来存放所述按照剩余数系统格式表示的数,第三字节
SEW
表明用于将每个剩余数系统数据寄存器组划分为多个元素的选定元素宽度,并且第四字节
SIGN
表明要进行的剩余数系统计算针对无符号模式还是有符号模式
。4.
如权利要求3所述的处理器,其中,每个所述剩余数系统数据寄存器具有
2^VLEN
个比特
。5.
如权利要求3所述的处理器,其中,
2^LMUL
个所述剩余数系统数据寄存器被分成一个剩余数系统数据寄存器组,每个剩余数系统数据寄存器组用来存放一个所述按照剩余数系统格式表示的数
。6.
如权利要求5所述的处理器,其中,每个剩余数系统数据寄存器组由其中最小的组成员来索引
。7.
如权利要求5所述的处理器,其中,将每个剩余数系统数据寄存器组划分为的多个元素中的每个元素具有
2^SEW
个比特,用来存放一个所述按照剩余数系统格式表示的数中的一个数字
。8.
如权利要求7所述的处理器,其中,每个剩余数系统数据寄存器组被划分为
2^(VLEN+LMUL
‑
SEW)
个元素
。9.
如权利要求3所述的处理器,其中,当所述第四字节
SIGN
的最低有效位被设置为0时,所述要进行的剩余数系统计算针对所述无符号模式,并且当所述第四字节
SIGN
的的最低有效位被设置为1时,所述要进行的剩余数系统计算针对所述有符号模式
。10.
如权利要求1所述的处理器,其中,所述运算电路执行的运算包括大数计算
。11.
如权利要求1所述的处理器,其中,所述剩余数系统运算指令包括:加载指令,用于将一系列二进制原始比特从存储器复制到所述剩余数系统数据寄存器中;存储指令,用于将一系列二进制原始比特从所述剩余数系统数据寄存器复制到存储器中;以及移动指令,用于将内容从所述剩余数系统数据寄存器中的一个剩余数系统数据寄存器复制到另一个剩余数系统数据寄存器
。
12. 如权利要求
11
所述的处理器,其中,所述加载指令还用于加载所剩余数系统的初始化模集
。13.
如权利要求
11
所述的处理器,其中,所述基于剩余数系统运算指令具有
32
个比特,所述
32
个比特中的第1到7比特是表明剩余数系统的第五代精简指令集计算机(
RISC
‑
V
)指令集体系结构(
ISA
)扩展的标识符,并且所述加载指令
、
所述存储指令和所述移动指令的
32
个比特中的第
13
到
15
比特表明具体的运算类型,第8到
12
比特和第
16
到
20
比特分别表明运算涉及的存储器地址或剩余数系统数据寄存器地址,并且第<...
【专利技术属性】
技术研发人员:张森杰,吴浩洋,张旭,
申请(专利权)人:英特尔中国研究中心有限公司,
类型:发明
国别省市:
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