【技术实现步骤摘要】
封装基板、微电子组件、POP封装组件以及电子设备
[0001]本专利技术涉及微电子领域,具体地,涉及封装基板
、
微电子组件
、POP
封装组件以及电子设备
。
技术介绍
[0002]随着微电子以及通讯技术的不断发展,低功耗双倍速率同步动态随机存储器
(Low Power Double Data Rate
,
LPDDR)
已成为目前的主流内存规范,被广泛应用于各类电子设备中
。
相关技术中基于搭载单颗动态随机存储芯片
(Dynamic Random Access Memory
,
DRAM)
的
LPDDR
通常具有4通道,可提供
64bits
的带宽
。
但随着当前应用处理器
(AP)
对于数据带宽的需求越来越高,
DRAM
与应用处理器之间通讯的带宽需要提升
。
并且,随着消费类电子设备整体向着轻薄化发展,需要
LPDDR
在不显著增大系统面积的前提下拓宽数据位宽
。
[0003]因此,目前的封装基板
、
微电子组件
、POP
封装组件以及电子设备仍有待改进
。
技术实现思路
[0004]本专利技术旨在一定程度上缓解甚至解决上述问题的至少之一
。
[0005]在本专利技术的一个方面,本专利技术提出 ...
【技术保护点】
【技术特征摘要】
1.
一种封装基板,其特征在于,所述封装基板具有用于设置引脚的周边区,所述周边区具有矩形的内周边以及矩形的外周边,所述内周边位于所述外周边内侧,所述外周边具有依次相连的第一至第四边,所述内周边具有依次相连的第五至第八边,其中所述第一边和所述第五边相邻且平行,所述第二边和所述第六边相邻且平行,所述周边区具有排布为多行和多列的引脚,多个所述引脚构成:位于第一区域的第一通道
、
位于第二区域的第二通道,位于第三区域的第三通道,位于第四区域的第四通道,位于第五区域的第五通道,位于第六区域的第六通道,位于第七区域的第七通道,和位于第八区域的第八通道,所述第一
、
第二区域位于所述第一边和第五边之间,所述第三区域和所述第四区域位于所述第三边和第七边之间,所述第五区域和所述第六区域位于所述第二边和第六边之间,所述第七区域和所述第八区域位于所述第四边和第八边之间
。2.
根据权利要求1所述的封装基板,其特征在于,所述封装基板具有所述引脚的一侧为第一表面,所述封装基板背离所述引脚的一侧为第二表面,所述第二表面用于设置多个存储颗粒
。3.
根据权利要求2所述的封装基板,其特征在于,所述第一通道
、
第二通道
、
第三通道
、
第四通道
、
第五通道
、
第六通道
、
第七通道以及第八通道用于并行访问所述多个存储颗粒,以提供
128bits
的数据访问带宽
。4.
根据权利要求1所述的封装基板,其特征在于,所述第一区域位于所述第一边的第一端和所述第五边的第一端之间的连线至所述第一边和第五边中线之间的区域,所述第一边的第一端和所述第五边的第一端临近设置;所述第二区域位于所述第一边的第二端和所述第五边的第二端之间的连线至所述第一边和第五边中线之间的区域;所述第三区域位于所述第三边的第一端和所述第七边的第一端之间的连线至所述第三边和第七边中线之间的区域,所述第三边的第一端和所述第七边的第一端临近设置;所述第四区域位于所述第三边的第二端和所述第七边的第二端之间的连线至所述第三边和第七边中线之间的区域;所述第五区域位于所述第二边的第一端和所述第六边的第一端之间的连线至所述第二边和第六边中线之间的区域,所述第二边的第一端和所述第六边的第一端临近设置;所述第六区域位于所述第二边的第二端和所述第六边的第二端之间的连线至所述第二边和第六边中线之间的区域;所述第七区域位于所述第四边的第一端和所述第八边的第一端之间的连线至所述第四边和第八边中线之间的区域,所述第四边的第一端和所述第八边的第一端临近设置;所述第八区域位于所述第四边的第二端和所述第八边的第二端之间的连线至所述第四边和第八边中线之间的区域
。5.
根据权利要求4所述的封装基板,其特征在于,所述第一至第八通道均包括依次排布的第一至第三子通道,所述第一以及第三子通道的多个所述引脚包括数据输入输出端
、
第一差分时钟信号端以及第二差分时钟信号端;所述第二子通道的多个所述引脚包括命令
/
地址端
、
片选端以及...
【专利技术属性】
技术研发人员:周子翔,黄成,褚雯,
申请(专利权)人:哲库科技上海有限公司,
类型:发明
国别省市:
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