【技术实现步骤摘要】
一种总线延时检测的验证装置与方法
[0001]本申请涉及芯片验证
,尤其涉及一种总线延时检测的验证装置与方法。
技术介绍
[0002]芯片的总线延时参数直接影响芯片的信息传输速度,因此需要对总线延时信息进行检测,以及时获取芯片的性能。
[0003]在验证芯片的总线延时检测时,可以基于UVM(Universal Verification Methodology,通用验证方法学)搭建验证环境。通过计算待验证芯片的总线延时,与验证模型生成的期望总线延时,可以判断待验证芯片的总线延时性能是否正常。
[0004]但在实际应用中,待验证芯片会多次进行迭代,待验证芯片的位宽参数也会随之变化。因此在验证时,对于验证环境的适应能力要求较高,导致验证环境的结构复杂,增加用于搭建验证环境的时间成本。
技术实现思路
[0005]本申请提供一种总线延时检测的验证装置与方法,以解决因芯片总线延时验证过程中,对验证环境的适应能力要求较高,导致验证环境的结构复杂,用于搭建验证环境的时间成本消耗较高的问题。
[0006]第一方面,本申请提供一种总线延时检测的验证装置,所述验证装置包括:待验证模块、检测模块、验证模型模块、通信模块和控制模块;所述通信模块包括第一VIP组件和自定义组件;
[0007]所述第一VIP组件与所述控制模块连接,所述第一VIP组件的AXI传输端口与所述待验证模块的AXI传输端口连接,以形成第一数据通道;所述第一VIP组件的AXI传输端口与所述验证模型模块的传输端口连接,以形成 ...
【技术保护点】
【技术特征摘要】
1.一种总线延时检测的验证装置,其特征在于,包括:待验证模块、检测模块、验证模型模块、通信模块和控制模块;所述通信模块包括第一VIP组件和自定义组件;所述第一VIP组件与所述控制模块连接,所述第一VIP组件的AXI传输端口与所述待验证模块的AXI传输端口连接,以形成第一数据通道;所述第一VIP组件的AXI传输端口与所述验证模型模块的传输端口连接,以形成第二数据通道;所述自定义组件分别与检测模块和待验证模块连接,以形成第三数据通道;其中,所述控制模块被配置为:控制所述第一VIP组件通过所述第一数据通道向所述待验证模块发送配置函数;响应于用于启动验证的启动指令,控制所述第一VIP组件通过第一数据通道向所述待验证模块发送测试信号,以及,控制所述第一VIP组件通过第二数据通道向所述验证模型模块发送测试信号;控制所述待验证模块将符合约束条件的测试信号的特征信息存入待验证数组,以生成待验证延时检测信息;以及控制所述验证模型模块将符合约束条件的测试信号的特征信息存入验证模型数组,以计算期望延时检测信息;控制检测模块通过所述第三数据通道从所述待验证模块中获取待验证延时检测信息,以及从所述验证模块模型中获取期望延时检测信息;若所述待验证延时检测信息符合所述期望延时检测信息,则标记所述待验证模块为可用状态。2.根据权利要求1所述的验证装置,其特征在于,还包括第二VIP组件;所述控制模块包括第一控制子模块和第二控制子模块;所述第一VIP组件与所述第一控制子模块连接,所述第一VIP组件的AXI传输端口与所述待验证模块的AXI传输端口连接,以形成第一数据通道;所述第一VIP组件的AXI传输端口与所述待验证模型模块的AXI传输端口连接,以形成第二数据通道;所述第二VIP组件与所述第二控制子模块连接,所述第二VIP组件的APB传输端口与所述待验证模块的APB传输端口连接,以形成第四数据通道。3.根据权利要求2所述的验证装置,其特征在于,所述控制模块还被配置为:控制所述第二控制子模块生成配置函数;控制所述第二控制子模块通过所述第四数据通道向所述待验证模块发送配置函数。4.根据权利要求1所述的验证装置,其特征在于,还包括用于配置所述验证装置所在验证环境的参数位宽的位宽配置模块,所述控制模块还被配置为:检测到所述待验证模块的位宽参数变化,通过修改所述位宽配置模块中的脚本文件配置所述验证环境的参数位宽;所述验证环境的参数位宽包括所述验证模型模块的参数位宽。5.根据权利要求1所述的验证装置,其特征在于,控制所述第一VIP组件通过第一数据通道向所述待验证模块发送测试信号,以及,控制所述第一VIP组件通过第二数据通道向所述验证模型模块发送测试信号时,所述控制模块被配置...
【专利技术属性】
技术研发人员:王正,
申请(专利权)人:爱芯元智半导体上海有限公司,
类型:发明
国别省市:
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