【技术实现步骤摘要】
一种二阶串行多数投票器电路
[0001]本专利技术涉及芯片设计领域,尤其涉及一种二阶串行多数投票器电路。
技术介绍
[0002]随着大数据和5G通信的发展,各种场景对基于SerDes的串行数据传输通信接口的速度的要求越来越高。因此,时钟数据恢复(Clock Data Recovery,CDR)电路成为了接口电路接收端的关键模块,CDR环路的性能决定了接收的数据的质量。
[0003]根据时钟/数据之间的相位关系,根据数据采样过程中的不同实现方法,CDR电路大致可以划分为前馈型、反馈型和盲过采样型三种类型。其中反馈型可进一步划分为基于锁相环(Phase Lock Loops, PLL)的CDR,基于延迟锁相环(Delay Locked Loop,DLL)的CDR,以及基于相位选择/相位插值(Phase Selection/ Phase Interpolation, PS/PI)的CDR。因为基于PS/PI的CDR可以共享参考多通道时钟,节省芯片面积和功耗,因此基于PS/PI的CDR电路被广泛地应用于低功耗并行转换器系统中 ...
【技术保护点】
【技术特征摘要】
1.一种二阶串行多数投票器电路,其特征在于:包括Bang
‑
Bang鉴相器(1)、串行多数投票器(2)、数字低通环路滤波器(3)、温度计码编码电路(4)、由相位插值器(5)及相位选择器(6)构成的PS/PI电路和提供外部参考时钟的锁相环;锁相环提供相位分别为0
°
、90
°
、180
°
和270
°
的四相位参考时钟,四种相位时钟采样后的数据输入Bang
‑
Bang鉴相器(1)产生相位差异信号,其中时钟速率是输入数据速率的一半;Bang
‑
Bang鉴相器(1)对四个数据的边缘信息进行合成,之后通过串行多...
【专利技术属性】
技术研发人员:夏迎军,邹尔博,程文韶,李邦旭,范强,
申请(专利权)人:武汉华中天经通视科技有限公司,
类型:发明
国别省市:
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