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用于处理文本串的指令和逻辑制造技术

技术编号:34911808 阅读:23 留言:0更新日期:2022-09-15 07:00
本发明专利技术提供一种用于处理文本串的指令和逻辑。用于执行串比较操作的方法、装置和程序模块。在一个实施例中,一种装置包括用来执行第一指令的执行资源。响应于所述第一指令,所述执行资源存储分别与第一和第二文本串相对应的第一和第二操作数的每个数据元素之间的比较结果。比较结果。比较结果。

【技术实现步骤摘要】
用于处理文本串的指令和逻辑
[0001]本申请是申请日为2007年9月24日、申请号为201610875178.X的同名专利申请的分案申请。


[0002]本公开内容属于执行逻辑和数学操作的处理装置以及相关软件和软件序列的领域。

技术介绍

[0003]在我们的社会中,计算机系统已经日益变得普遍。计算机的处理能力提高了许多职业范围内的工作者的效率和生产率。随着购买和拥有计算机的费用持续下降,越来越多的消费者能够利用更新和更快的机器。此外,许多人因为自由而热衷于使用笔记本电脑。移动计算机允许用户在他们离开办公室或旅行时容易地运送他们的数据和工作。这种情况对于销售人员、团体执行人员甚至学生都是十分常见的。
[0004]随着处理器技术的发展,还产生了要在具有这些处理器的机器上运行的更新的软件代码。用户通常希望和需要从他们的计算机获得更高的性能,而不考虑所使用的软件类型。从所述处理器内实际执行的多种指令和操作将会产生一个这样的问题。基于操作的复杂度和/或所需的电路类型,特定类型的操作需要更多的时间来完成。这提供了一个机会来优化在处理器内执行本文档来自技高网...

【技术保护点】

【技术特征摘要】
1.一种处理器,包括:多级高速缓存,其包括一级(L1)高速缓存;译码器,其用于对单指令多数据(SIMD)比较指令进行译码,所述SIMD比较指令具有用于识别第一源SIMD寄存器的第一字段,具有用于识别第二源SIMD寄存器的第二字段,并具有用于识别第三源寄存器的第三字段,所述第一源SIMD寄存器用于存储第一多个数据元素,所述第二源SIMD寄存器用于存储第二多个数据元素,所述第三源寄存器用于存储对应于所述第一多个数据元素中的不同数据元素的多个位;执行单元,其与所述译码器耦合,所述执行单元用于执行对应于所述SIMD比较指令的操作,所述操作包括:对于所述多个位中为1的每一个位:将所述第一多个数据元素中的相应数据元素与所述第二多个数据元素中的至少一个数据元素进行比较;以及在目的地中存储相应的比较结果,所述相应的比较结果指示所述第一多个数据元素中的相应数据元素是否与所述第二多个数据元素中的任意一个数据元素匹配。2.根据权利要求1所述的处理器,其中,对于所述多个位中为1的每一个位,所述执行单元用于将所述第一多个数据元素中的相应数据元素与所述第二源SIMD寄存器中的所有数据元素进行比较。3.根据权利要求1或2所述的处理器,其中,所述执行单元执行对应于所述SIMD比较指令的操作用于在多个标志中存储基于所述结果的指示。4.根据权利要求1至3中的任意一项所述的处理器,其中,所述第一多个数据元素和所述第二多个数据元素是8位数据元素,并且其中,对于所述多个位中为1的每一个位,所述执行单元用于将所述第一多个数据元素中的相应数据元素与所述第二多个数据元素中的16个数据元素进行比较。5.根据权利要求1至4中的任意一项所述的处理器,其中,所述第一多个数据元素和所述第二多个数据元素是16位数据元素,并且其中,对于所述多个位中为1的每一个位,所述执行单元用于将所述第一多个数据元素中的相应数据元素与所述第二多个数据元素中的8个数据元素进行比较。6.根据权利要求1至5中的任意一项所述的处理器,其中,所述第一多个数据元素是8位数据元素或者16位数据元素。7.根据权利要求1至6中的任意一项所述的处理器,其中,所述结果包括掩码值。8.根据权利要求1至7中的任意一项所述的处理器,其中,所述处理器是精简指令集计算(RISC)处理器。9.根据权利要求1至8中的任意一项所述的处理器,其中,所述第一多个数据元素是字符串,并且其中,所述指令是串处理指令。10.根据权利要求1至9中的任意一项所述的处理器,其中,所述SIMD比较指令是串处理指令。11.一种方法,包括:接收单指令多数据(SIMD)比较指令;以及执行操作以实施所述SIMD比较指令,包括:
从第一SIMD寄存器接收第一字符串的第一多个数据元素;从第二SIMD寄存器接收第二字符串的第二多个数据元素;从第三源寄存器接收对应于所述第一多个数据元素中的不同数据元素的多个位;以及对于所述多个位中为1的每一个位:将所述第一多个数据元素中的相应数据元素与所述第二多个数据元素中的至少一个数据元素进行比较;以及在结果中存储相应的比较结果,所述相应的比较结果指示所述第一多个数据元素中的相应数据元素是否与所述第二多个数据元素中的任意一个数据元素匹配。12.根据权利要求11所述的方法,其中,所述第一多个数据元素是字符串,其中,对于所述多个位中为1的每一个位,所述比较包括将所述第一多个数据元素中的相应数据元素与所述第二源SIMD寄存器中的所有数据元素进行比较。13.根据权利要求11或12所述的方法,其中,所述第一多个数据元素和所述第二多个数据元素是16位数据元素,其中,对于所述多个位中为1的每一个位,所述比较包括将所述第一多个数据元素中的相应数据元素与所述第二多个数据元素中的8个数据元素进行比较,并且所述方法还包括使用所述比较结果来检测所述第一串中的字与所述第二串中的字匹配。14.一种机器可读介质,其上存储有指令,所述指令在由机器执行时使得所述机器执行包括以下的操作:接收单指令多数据(SIMD)比较指令;以及执行操作以实施所述SIMD比较指令,包括:从第一SIMD寄存器接收第一字符串的第一多个数据元素;从第二SIMD寄存器接收第二字符串的第二多个数据元素;从第三源寄存器接收对应于所述第一多个数据元素中的不同数据元素的多个位;以及对于所述多个位中为1的每一个位:将所述第一多个数据元素中的相应数据元素与所述第二多个数据元素中的至少一个数据元素进行比较;以及在结果中存储相应的比较结果,所述相应的比较结果指示所述第一多个数据元素中的相应数据元素是否与所述第二多个数据元素中的任意一个数据元素匹配。15.根据权利要求14所述的机器可读介质,其中,所述指令在由所述机器执行时使得所述机器执行包括以下的操作:对于所述多个位中为1的每一个位,将所述第一多个数据元素中的相应数据元素与所述第二源SIMD寄存器中的所有数据元素进行比较,其中,所述第一多个数据元素中的相应数据元素是文本串的一部分。16.根据权利要求14或15所述的机器可读介质,其中,在由所述机器执行时使得所述机器执行将所述第一多个数据元素中的相应数据元素与所述第二多个数据元素中的至少一个数据元素进行比较的所述指令还包括:在由所述机器执行时使得所述机器将所述第一多个数据元素中的相应数据元素与所述第二多个数据元素中的8个16位数据元素进行比较的指令,并且还包括在由所述机器执行时使得所述机器执行包括使用所述比较结果来检测所述第一串中的字与所述第二串中的字匹配的操作的指令。17.一种系统,包括:
存储器控制器;以及处理器,其与所述存储器控制器耦合,所述处理器包括:多级高速缓存,其包括一级(L1)高速缓存;译码器,其用于对单指令多数据(SIMD)比较指令进行译码,所述SIMD比较指令具有用于识别第一源SIMD寄存器的第一字段,具有用于识别第二源SIMD寄存器的第二字段,并具有用于识别第三源寄存器的第三字段,所述第一源SIMD寄存器用于存储第一多个数据元素,所述第二源SIMD寄存器用于存储第二多个数据元素,所述第三源寄存器用于存储对应于所述第一多个数据元素中的不同数据元素的多个位;执行单元,其与所述译码器耦合,所述执行单元用于执行对应于所述SIMD比较指令的操作,所述操作包括:对于所述多个位中为1的每一个位:将所述第一多个数据元素中的相应数据元素与所述第二多个数据元素中的至少一个数据元素进行比较;以及在目的地中存储相应的比较结果,所述相应的比较结果指示所述第一多个数据元素中的相应数据元素是否与所述第二多个数据元素中的任意一个数据元素匹配。18.根据权利要求17所述的系统,其中,对于所述多个位中为1的每一个位,所述执行单元用于将所述第一多个数据元素中的相应数据元素与所述第二源SIMD寄存器中的所有数据元素进行比较,并且所述系统还包括与所述处理器耦合的图形组件。19.根据权利要求17或18所述的系统,其中,所述执行单元执行对应于所述SIMD比较指令的操作用于在多个标志中存储基于所述结果的指示,并且其中,所述SIMD比较指令是串处理指令,并且所述系统还包括与所述处理器耦合的输入/输出控制器。20.根据权利要求17至19中的任意一项所述的系统,其中,所述第一多个数据元素和所述第二多个数据元素是8位数据元素,并且其中,对于所述多个位中为1的每一个位,所述执行单元用于将所述第一多个数据元素中的相应数据元素与所述第二多个数据元素中的16个数据元素进行比较,并且所述系统还包括与所述处理器耦合的音频控制器。21.根据权利要求17至20中的任意一项所述的系统,其中,所述第一多个数据元素和所述第二多个数据元素是16位数据元素,并且其中,对于所述多个位中为1的每一个位,所述执行单元用于将所述第一多个数据元素中的相应数据元素与所述第二多个数据元素中的8个数据元素进行比较,其中,所述结果包括掩码值,并且所述系统还包括与所述处理器耦合的到网络控制器的接口。22.一种系统,包括:系统存储器;以及处理器,其与所述系统存储器耦合,所述处理器包括:多级高速缓存,其包括一级(L1)高速缓存;译码器,其用于对单指令多数据(SIMD)比较指令进行译码,所述SIMD比较指令具有用于识别第一源SIMD寄存器的第一字段,具有用于识别第二源SIMD寄存器的第二字段,并具有用于识别第三源寄存器的第三字段,所述第一源SIMD寄存器用于存储第一多个数据元素,所述第二源SIMD寄存器用于存储第二多个数据元素,所述第二源寄存器用于存储对应于所述第一多个数据元素中的不同数据元素的多个位;
执行单元,其与所述译码器耦合,所述执行单元用于执行对应于所述SIMD比较指令的操作,所述操作包括:对于所述多个位中为1的每一个位:将所述第一多...

【专利技术属性】
技术研发人员:M
申请(专利权)人:英特尔公司
类型:发明
国别省市:

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