【技术实现步骤摘要】
一种雷达信号接收机
[0001]本专利技术涉及一种雷达信号接收机。
技术介绍
[0002]雷达数字接收机采用数字信号处理，使用易于实现算法的FPGA、CPLD或专用的DSP芯片，体积小，重量轻，造价低，结构简单，易模块化，系统配置更新块，维护升级方便，具有数字化的优点。对于此，如何提供其使用的性价比，使用效率，延长器使用寿命成为日益研究的热点。
技术实现思路
[0003]本专利技术的目的是提供一种雷达信号接收机。
[0004]为解决上述技术问题，本专利技术提供一种雷达信号接收机，其包括依次连接的数控增益放大器、中频低噪声放大模块、抗混叠滤波器、高速高精度ADC、接收信号处理器AD6620、FPGA和DSP；数控增益放大器中频低噪声放大模块用于实现中频信号放大的增益调节，数字宽带滤波由接收信号处理器AD6620内抽取滤波器和基于FPGA的FIR滤波器共同处理，FPGA和DSP用以实现数字解调、解扩等基带信号处理任务。
[0005]进一步地，抗混叠滤波器采用插损较低的LC无源带通滤波器。
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【技术保护点】
【技术特征摘要】
1.一种雷达信号接收机，其特征在于：包括依次连接的数控增益放大器、中频低噪声放大模块、抗混叠滤波器、高速高精度ADC、接收信号处理器AD6620、FPGA和DSP；所述数控增益放大器中频低噪声放大模块用于实现中频信号放大的增益调节，数字宽带滤波由所述接收信号处理器AD6620内抽取滤波器和基于FPGA的FIR滤波器共同处理，所述FPGA和DSP用以实现数字解调、解扩等基带信...
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