【技术实现步骤摘要】
电容式环形振荡器的频率校准方法、装置、介质及设备
本申请涉及集成电路设计领域,特别涉及一种电容式环形振荡器的频率校准方法、装置、介质及设备。
技术介绍
CMOS反相器级联的环形振荡器的电路在连续结点电压之间以TD延时振荡,产生的振荡周期为6TD,频率为1/(6TD)。环路反相的次数必须是奇数次,否则电路会锁定。差分形式级联的环形振荡器虽然相比于CMOS反相器级联的环形振荡器的电路更加灵活,并且其计数可以为偶数。现有技术虽然能通过由延时单元构成的环路产生振荡,提供时钟,但是不具备频率校准功能,芯片封装后振荡输出频率无法进行校准,进而导致时钟精度不够精确且无法校准。
技术实现思路
针对现有技术中的环形振荡器不具备频率校准功能,芯片封装后振荡输出频率无法进行校准,进而导致时钟精度不够精确且无法校准的问题,本申请主要提供一种电容式环形振荡器的频率校准方法、装置、介质及设备。为了实现上述目的,本申请采用的一个技术方案是:提供一种电容式环形振荡器的频率校准方法,其包括,每隔预设等待周期,在待校准信号的预设数目个周期内,对时钟信号的上升沿个数进行计数,得到当前计数值;根据当前计数值和理论数值,对电容逻辑值的当前逻辑状态进行调节,从而改变电容值,进而校准待校准信号的频率,其中,理论数值为在目标输出信号的预设数目个周期内,时钟信号的上升沿个数,目标输出信号与待校准信号对应。本申请采用的另一个技术方案是:提供一种电容式环形振荡器的频率校准装置,其包括,数字模块,其用于根据逻辑输入控制预设等待周 ...
【技术保护点】
1.一种电容式环形振荡器的频率校准方法,其特征在于,包括:/n每隔预设等待周期,在待校准信号的预设数目个周期内,对时钟信号的上升沿个数进行计数,得到当前计数值;/n根据所述当前计数值和理论数值,对电容逻辑值的当前逻辑状态进行调节,从而改变电容值,进而校准所述待校准信号的频率,其中,所述理论数值为在目标输出信号的所述预设数目个周期内,所述时钟信号的上升沿个数,所述目标输出信号与所述待校准信号对应。/n
【技术特征摘要】
1.一种电容式环形振荡器的频率校准方法,其特征在于,包括:
每隔预设等待周期,在待校准信号的预设数目个周期内,对时钟信号的上升沿个数进行计数,得到当前计数值;
根据所述当前计数值和理论数值,对电容逻辑值的当前逻辑状态进行调节,从而改变电容值,进而校准所述待校准信号的频率,其中,所述理论数值为在目标输出信号的所述预设数目个周期内,所述时钟信号的上升沿个数,所述目标输出信号与所述待校准信号对应。
2.如权利要求1所述的电容式环形振荡器的频率校准方法,其特征在于,所述根据所述当前计数值和理论数值,对电容逻辑值的当前逻辑状态进行调节,从而改变电容值,进而校准所述待校准信号的频率,包括:
若所述当前计数值超出预设范围,则根据所述当前计数值与所述理论数值的大小关系,对所述电容逻辑值的所述当前逻辑状态进行调节,得到所述电容逻辑值的第i更新逻辑状态,其中,所述预设范围根据所述理论数值确定,i的取值为不大于调节总数的正整数,所述调节总数小于所述电容逻辑值的位数;
根据所述第i更新逻辑状态对应的第i十进制数值,确定所述电容值,进而校准所述待校准信号的频率,其中,所述第i十进制数值越大,所述电容值越大,所述待校准信号的频率越小。
3.如权利要求2所述的电容式环形振荡器的频率校准方法,其特征在于,所述对所述电容逻辑值的所述当前逻辑状态进行调节,得到所述电容逻辑值的第i更新逻辑状态,包括:
根据所述电容逻辑值的第i次高位对应的第i十进制数值,对所述电容逻辑值对应的十进制数值进行增大或减小,从而调节所述电容逻辑值的所述当前逻辑状态,得到所述电容逻辑值的所述第i更新逻辑状态。
4.如权利要求3所述的电容式环形振荡器的频率校准方法,其特征在于,所述根据所述电容逻辑值的第i次高位对应的第i十进制数值,对所述电容逻辑值对应的十进制数值进行增大或减小,从而调节所述电容逻辑值的所述当前逻辑状态,得到所述电容逻辑值的所述第i更新逻辑状态,包括:
若所述当前计数值大于所述理论数值,则减小所述当前逻辑状态对应的十进制数值,得到所述电容逻辑值的第i1更新逻辑状态;
若所述当前计数值小于所述理论数值,则增大所述当前逻辑状态对应的十进制数值,得到所述电容逻辑值的第i2更新逻辑状态,其中,所述第i更新逻辑状态包含所述第i1更新逻辑状态或所述第i2更新逻辑状态。
5.如权利要求2所述的电容式环形振荡器的频率校准方法,其特征在于,在所述根据第i更新逻辑状态对应的第i十进制数值,确定所述电容值,进而校准所述待校准信号的频率之后,还包括:
当所述待校准信号的频率发生校准变化后,将所述第i...
【专利技术属性】
技术研发人员:苏杰,李孙华,徐祎喆,朱勇,
申请(专利权)人:重庆百瑞互联电子技术有限公司,
类型:发明
国别省市:重庆;50
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