一种介面控制器制造技术

技术编号:2890656 阅读:171 留言:0更新日期:2012-04-11 18:40
一种连接在电视游戏器和个人电脑介面卡间的介面控制器,主要是将电视游戏器扩充槽介面的信号转换成个人电脑标准总线介面信号,使电视游戏器能通过该介面控制器,直拉存取数据于原先插在个人电脑标准总线的介面卡,以提高电视游戏器扩充槽介面的价值。该介面控制器包括:一地址锁住信号、高低位元组选择信号及终止计数信号产生电路,一地址解码电路,一记忆体及输入/输出的读取/信号产生电路及一数据传输认可信号产生电路。(*该技术在2015年保护过期,可自由使用*)

【技术实现步骤摘要】

本专利技术有关于一种介面控制器(Interface Controller),尤指一种电视游戏器和个人电脑介面卡间的介面控制器,可使得电视游戏器的主机能通过该介面控制器,直接存取(access)到原先插于个人电脑上的工业标准结构总线(ISAbus,Industrial StandardArchitecture bus)的介面卡,以提高一般电视游戏器扩充槽介面的价值。一般电视游戏器的功能,虽然主要仅是针对电脑游戏软件使用,但由于一般电视游戏器的系统结构,已包括有中央处理机(CPU,Central Processor Unit)、记忆体(memory)及输入/输出接口(I/O port,Input/output port)等组件,类似于个人电脑;因此,若能使电视游戏器与个人电脑的ISA总线上的介面卡间,作直接存取数据的动作,则可大大提高电视游戏器扩充槽介面的价值,使电视游戏器可简易地直接使用许多ISA总线介面卡。本专利技术的主要目的,在于提供一种电视游戏器和个人电脑介面卡间的介面控制器,作为电视游戏器的扩充槽介面和个人电脑的ISA总线间的桥梁,使电视游戏器可直接使用难以数计的ISA总线介面卡,以提高电视游戏器扩充槽介面的价值。本技术的介面控制器,连接于电视游戏器和个人电脑介面卡间,其特征在于其包括一地址锁住信号、高低位元组选择信号及终止计数信号产生电路,由电视游戏器扩充槽介面输入地址触发信号、输出致能信号、时脉信号、高低位元组写入信号、重置信号、选择控制信号及数据信号,以分别产生地址锁住信号、高低位元组选择信号及终止计数信号,连接至个人电脑标准总线;一地址解码电路,由电视游戏器扩充槽介面输入地址讯号,以产生一地址启动信号至个人电脑标准总线,该地址启动信号在低电位时,输入/输出接口才可用地址来解码;一记忆体及输入/输出读取/写入信号产生电路,由电视游戏;器扩充槽介面输入地址信号、地址触发信号、输出致能信号、时脉信号、重置信号、选择控制信号及数据信号,另由个人电脑标准总线输入地址锁住信号、十六位元记忆体选择信号及地址启动信号等,以分别产生记忆体读取信号、记忆体写入信号、输入/输出接口读取信号及输入/输出接口写入信号,连接至个人电脑标准总线;一种传输认可信号产生电路,由个人电脑标准总线输入地址锁住信号、地址启动信号、十六位元记忆体选择信号、十六位元输入/输出接口选择信号、输入/输出通道备妥信号及零等待状态信号,另由电视游戏器扩充槽介面输入时脉信号、地址触发信号、选择控制信号、数据信号及重置信号等,以产生一数据传输认可信号,连接至电视游戏器扩充槽介面;藉由所述介面控制器,将电视游戏器扩充槽介面;借由所述介面控制器,将电视游戏器扩充槽介面的信号转换成个人电脑标准总线介面信号,并依据所述个人电脑标准总线介面信号的状态,产生一数据传输认可信号输至电视游戏器,使电视游戏器可直接于个人电脑标准总线上的介面卡存取数据信号。结合附图及实施例对本专利技术的目的、特征及功效,详细说明如下附图简单说明附图说明图1为本专利技术的方块图。图2为本专利技术的实施例的方块图。图3为本专利技术实施例的电路方块图。图4为本专利技术实施例的八位记忆体读取的标准周期时序图。图5为本专利技术实施例的八位元记忆体写入的标准周期时序图。图6为本专利技术实施例的八位记忆体读取的插入等待状态时序图。图7为本专利技术实施例的八位记忆体写入的插入等待状态时序图。图8为本专利技术实施例的八位记忆体读取的零等待状态时序图。图9为本专利技术实施例的八位元记忆体写入零等待状态时序图。图10为本专利技术实施例的八位元输入/输出接口读取的标准周期时序图。图11为本专利技术实施例的八位元输入/输出接口写入的标准周期时序图。图12为本专利技术实施例的八位元输入/输出接口读取的插入等待状态时序图。图13为本专利技术实施例的八位元输入/输出接口写入的插入等待状态时序图。图14为本专利技术实施例的八位元输入/输出接口读取的零等待状态时序图。图15为本专利技术实施例的八位元输入/输出接口写入的零等待状态时序图。图16为本专利技术实施例的十六位元记忆体读取的标准周期时序图。图17为本专利技术实施例的十六位元记忆体写入的标准周期时序图。图18为本专利技术实施例的十六位元记忆体读取的插入等待状态时序图。图19为本专利技术实施例产十六位元记忆体写入的插入等待状态时序图。图20为本专利技术实施例的十六位元输入/输出接口读取的标准周期时序图。图21为本专利技术实施例的十六位元输入/输出接口写入的标准周期时序图。图22为本专利技术实施例的十六位元输入/输出接口读取的插入等待状态时序图。图23为本专利技术实施例的十六元输入/输出接口写入的插入等待状态时序图。首先,请参阅图1,其为本专利技术的方块图,本专利技术主要是在一般电视游戏器1和个人电脑介面卡2之间,设计出一种介面控制器3,以使电视游戏器1可通过介面控制器3,直接使用个人电脑介面卡2。如图2所示,其为本专利技术实施例的方块示意图,一电视游戏器扩充槽介面10的各信号,将转换成个人电脑ISA总线20的介面信号,该信号的转换由一介面控制器30完成,并依据个人电脑ISA总线20的介面信号的状态,将一数据传输认可信号DTAK#,送至电视游戏器扩充槽介面10以作控制。其次,参阅图3,其为本专利技术实施例的电路方块图,图中的介面控制器30主要包括有一地址锁住信号、高低位元组选择信号及终止计数讯产生电路31、一地址解码电路32、一记忆体及输入/输出接口读取/写入信号产生电路33及一数据传输认可信号产生电路34等组成,其中除了数据传输认可信号产生电路34,是依据个人电脑ISA总线20的介面信号的状态来产生数据传输认可信号DTAK#,以送至电视游戏器扩充槽介面10外,其余则均由电视游戏器扩充槽介面10的各信号,转换成个人电脑ISA总线20的介面信号。接下来,图4至图23,为本专利技术实施例于各种可能情况下的各时序图,可一一用来说明本专利技术实施人例的介面控制器30的各信号转换情形。如图4所示,其为本专利技术实施例的八位元记忆体(memory)读取(read)的标准周期(standard cycle)时序图,当电视游戏器扩充槽介面10欲对个人电脑ISA总线20的介面卡,进行八位记忆体读取数据的标准周期时,电视游戏器扩充槽介面10的高位元组写入信号UWR#及低位元组写入信号LWR#均为高电位,输出致能信号CASO#为低电位,配合地址触发信号AS#为低电位及时脉信号VCLK的周期,可产生一个人电脑ISA总线20的地址锁住信号BALE,该地址锁住信号BALE为一半周期的脉冲波,可用来锁住地址线。至于地址线AO,可先以选择控制信号TIME#及数据线D1控制产生,以决定读取奇数或偶数位元组。而十六位元记忆体选择信号MEMCS16#为一高电位,指示目前是八位元的记忆体装置在传送数据。同理,可产生记忆体读入信号MEMR#、SMEMR#,该记忆体读入信号MEMR#、SMEMR#为低电位时,指示记忆体把数据放在数据总线D7-DO线上,其中MEMR#信号在所有的记忆体空间的读取动作均会动作,SMEMR#信号只在地址低于1MB(megabyte)的记忆体空间内动作。当个电脑ISA总线20的输入/输出通道备妥信号IOCHRDY及零等待状态信号OWS#均为高电位,且在地址锁住信号BALE产生后,将本文档来自技高网...

【技术保护点】
一种介面控制器,连接于电视游戏器和个人电脑介面卡间,其特征在于:其包括:一地址锁住信号、高低位元组选择信号及终止计数信号产生电路,由电视游戏器扩充槽介面输入地址触发信号、输出致能信号、时脉信号、高低位元组写入信号、重置信号、选择控制信号 及数据信号,以分别产生地址锁住信号、高低位元组选择信号及终止计数信号,连接至个人电脑标准总线;一地址解码电路,由电视游戏器扩充槽介面输入地址讯号,以产生一地址启动信号至个人电脑标准总线,该地址启动信号在低电位时,输入/输出接口才可用地址 来解码;一记忆体及输入/输出读取/写入信号产生电路,由电视游戏;器扩充槽介面输入地址信号、地址解发信号、输出致能信号、时脉信号、重置信号、选择控制信号及数据信号,另由个人电脑标准总线输入地址锁住信号、十六位元记忆体选择信号及地址启动信号 等,以分别产生记忆体读取信号、记忆体写入信号、输入/输出接口读取信号及输入/输出接口写入信号,连接至个人电脑标准总线;一种传输认可信号产生电路,由个人电脑标准总线输入地址锁住信号、地址启动信号、十六位元记忆体选择信号、十六位元输入/输出 接口选择信号、输入/输出通道备妥信号及零等待状态信号,另由电视游戏器扩充槽介面输入时脉信号、地址触发信号、选择控制信号、数据信号及重置信号等,以产生一数据传输认可信号,连接至电视游戏器扩充槽介面;藉由所述介面控制器,将电视游戏器扩充槽介面借由所述介面控制器,将电视游戏器扩充槽介面的信号转换成个人电脑标准总线介面信号,并依据所述个人电脑标准总线介面信号的状态,产生一数据传输认可信号输至电视游戏器,使电视游戏器可直接于个人电脑标准总线上的介面卡存取数据信号。...

【技术特征摘要】

【专利技术属性】
技术研发人员:萧祝瓜
申请(专利权)人:盛群半导体股份有限公司
类型:发明
国别省市:71[中国|台湾]

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