本发明专利技术公开了一种像素驱动电路、像素驱动电路的驱动方法和显示面板。该像素驱动电路包括驱动晶体管、数据写入模块、置位模块、存储模块、发光控制模块和发光模块；置位模块用于在数据写入阶段置位驱动晶体管的栅极为第一电位；数据写入模块用于在数据写入阶段向存储模块写入数据电压；驱动晶体管用于在数据写入阶段补偿驱动晶体管的阈值电压；存储模块用于存储数据电压和第一电位；发光控制模块用于在发光阶段连通存储模块和驱动晶体管的栅极，以及连通驱动晶体管和发光模块，使驱动晶体管根据数据电压和第一电位驱动发光模块发光，可以提高显示面板的显示均一性。高显示面板的显示均一性。高显示面板的显示均一性。
【技术实现步骤摘要】
像素驱动电路、像素驱动电路的驱动方法和显示面板
[0001]本专利技术实施例涉及显示
，尤其涉及一种像素驱动电路、像素驱动电路的驱动方法和显示面板。
技术介绍
[0002]在显示面板显示的过程中，像素驱动电路中的驱动晶体管根据数据电压形成驱动电流驱动发光器件发光。驱动电流的大小与像素驱动电路的电源信号相关。在显示面板中，提供电源信号的电源信号线具有压降，显示面板中不同位置的像素驱动电路的电源信号不同，导致不同的像素驱动电路驱动发光器件发光的亮度不同，显示面板的显示均一性比较差。
技术实现思路
[0003]本专利技术提供一种像素驱动电路、像素驱动电路的驱动方法和显示面板，以提供显示面板的显示均一性。
[0004]第一方面，本专利技术实施例提供了一种像素驱动电路，包括驱动晶体管、数据写入模块、置位模块、存储模块、发光控制模块和发光模块；
[0005]所述置位模块用于在数据写入阶段置位所述驱动晶体管的栅极为第一电位；
[0006]所述数据写入模块用于在所述数据写入阶段向所述存储模块写入数据电压；
[0007]所述驱动晶体管用于在所述数据写入阶段补偿所述驱动晶体管的阈值电压；
[0008]所述存储模块用于存储所述数据电压和所述第一电位；
[0009]所述发光控制模块用于在发光阶段连通所述存储模块和所述驱动晶体管的栅极，以及连通所述驱动晶体管和所述发光模块，使所述驱动晶体管根据所述数据电压和所述第一电位驱动所述发光模块发光。
[0010]可选地，所述置位模块包括第一晶体管；所述第一晶体管的栅极与第一扫描信号输入端连接，所述第一晶体管的第一极与第一电位输入端连接，所述第一晶体管的第二极与所述驱动晶体管的栅极连接。
[0011]可选地，所述发光控制模块包括第二晶体管和第三晶体管；所述存储模块包括存储电容；所述发光模块包括发光器件；
[0012]所述第二晶体管的栅极和所述第三晶体管的栅极与发光控制信号输入端连接，所述第二晶体管的第一极与所述存储电容的第一极连接，所述第二晶体管的第二极与所述驱动晶体管的栅极连接，所述第三晶体管的第一极和所述存储电容的第二极与所述驱动晶体管的第二极连接，所述第三晶体管的第二极与所述发光器件的正极连接，所述驱动晶体管的第一极与第一电源信号输入端连接，所述发光器件的负极与所述第二电源信号输入端连接。
[0013]可选地，所述数据写入模块包括第四晶体管；
[0014]所述第四晶体管的栅极与所述第一扫描信号输入端连接，所述第四晶体管的第一
极与数据电压输入端连接，所述第四晶体管的第二极与所述存储电容的第一极连接。
[0015]可选地，像素驱动电路还包括第一初始化模块和第二初始化模块；
[0016]所述第一初始化模块用于在初始化阶段对所述发光器件复位；
[0017]所述第二初始化模块用于在所述初始化阶段对所述驱动晶体管的栅极复位。
[0018]可选地，所述第一初始化模块包括第五晶体管，所述第二初始化模块包括第六晶体管；
[0019]所述第五晶体管的栅极和所述第六晶体管的栅极与第二扫描信号输入端连接，所述第五晶体管的第一极与第一初始化信号输入端连接，所述第五晶体管的第二极与所述驱动晶体管的第二极连接，所述第六晶体管的第一极与第二初始化信号输入端连接，所述第六晶体管的第二极与所述第二晶体管的第一极连接。
[0020]可选地，所述驱动晶体管和所述第一晶体管至所述第六晶体管均为N型晶体管；
[0021]所述第二初始化信号输入端提供的第二初始化信号大于所述第一初始化信号输入端提供的第一初始化信号和所述驱动晶体管的阈值电压之和，所述第一初始化信号和所述驱动晶体管的阈值电压之和大于所述发光器件的阈值电压。
[0022]可选地，所述第一电位输入端复用为所述第二初始化信号输入端。
[0023]第二方面，本专利技术实施例还提供了一种像素驱动电路的驱动方法，用于驱动本专利技术任意实施例提供的像素驱动电路，包括：
[0024]在数据写入阶段，所述置位模块置位所述驱动晶体管的栅极为第一电位，所述驱动晶体管补偿所述驱动晶体管的阈值电压，所述数据写入模块向所述存储模块写入数据电压，所述存储模块存储所述数据电压和所述第一电位；
[0025]在发光阶段，所述发光控制模块连通所述存储模块和所述驱动晶体管的栅极，以及连通所述驱动晶体管和所述发光模块，使所述驱动晶体管根据所述数据电压和所述第一电位驱动所述发光模块发光。
[0026]第三方面，本专利技术实施例还提供了一种显示面板，包括n级级联的移位寄存器和多个本专利技术任意实施例提供的像素驱动电路；
[0027]第i级所述移位寄存器的输出端与第i行所述像素驱动电路的第一扫描信号输入端连接，第i-1级所述移位寄存器的输出端与第i行所述像素驱动电路的第二扫描信号输入端连接；其中，i为大于1且小于n的整数，n为所述像素驱动电路的行数。
[0028]本专利技术实施例的技术方案，像素驱动电路中的置位模块在数据写入阶段置位驱动晶体管的栅极为第一电位，并使驱动晶体管导通，使驱动晶体管的第二极写入第一电源信号，直至驱动晶体管的第二极电位为第一电位与驱动晶体管的阈值电压之差，驱动晶体管截止，实现驱动晶体管的阈值补偿。同时数据写入模块向存储模块写入数据电压。在发光阶段，存储模块存储的数据电压通过发光控制模块传输至驱动晶体管的栅极，驱动晶体管根据栅极的数据电压和第二极的第一电位与驱动晶体管的阈值电压之差形成驱动电流，并通过发光控制模块传输至发光模块，驱动发光模块发光。驱动晶体管形成的驱动电流与数据电压和第一电位相关，而与驱动晶体管的阈值电压和第一电源信号输入端提供的第一电源信号无关，因此可以实现对电源信号线的压降和驱动晶体管的阈值电压的补偿，提高了显示面板的显示均一性。
附图说明
[0029]图1为现有技术提供的一种像素驱动电路的电路结构示意图；
[0030]图2为本专利技术实施例提供的一种像素驱动电路的结构示意图；
[0031]图3为本专利技术实施例提供的另一种像素驱动电路的结构示意图；
[0032]图4为本专利技术实施例提供的另一种像素驱动电路的结构示意图；
[0033]图5为本专利技术实施例提供的另一种像素驱动电路的结构示意图；
[0034]图6为图5提供的像素驱动电路对应的一种时序图；
[0035]图7为本专利技术实施例提供的另一种像素驱动电路的结构示意图；
[0036]图8为图7提供的像素驱动电路对应的一种时序图；
[0037]图9为本专利技术实施例提供的另一种像素驱动电路的结构示意图；
[0038]图10为本专利技术实施例提供的一种像素驱动电路的驱动方法的流程示意图；
[0039]图11为本专利技术实施例提供的一种显示面板的结构示意图。
具体实施方式
[0040]下面结合附图和实施例对本专利技术作进一步的详细说明。可以理解的是，此处所描述的具体实施例仅仅用于解释本专利技术，而非对本文档来自技高网...
【技术保护点】
【技术特征摘要】
1.一种像素驱动电路，其特征在于，包括驱动晶体管、数据写入模块、置位模块、存储模块、发光控制模块和发光模块；所述置位模块用于在数据写入阶段置位所述驱动晶体管的栅极为第一电位；所述数据写入模块用于在所述数据写入阶段向所述存储模块写入数据电压；所述驱动晶体管用于在所述数据写入阶段补偿所述驱动晶体管的阈值电压；所述存储模块用于存储所述数据电压和所述第一电位；所述发光控制模块用于在发光阶段连通所述存储模块和所述驱动晶体管的栅极，以及连通所述驱动晶体管和所述发光模块，使所述驱动晶体管根据所述数据电压和所述第一电位驱动所述发光模块发光。2.根据权利要求1所述的像素驱动电路，其特征在于，所述置位模块包括第一晶体管；所述第一晶体管的栅极与第一扫描信号输入端连接，所述第一晶体管的第一极与第一电位输入端连接，所述第一晶体管的第二极与所述驱动晶体管的栅极连接。3.根据权利要求1或2所述的像素驱动电路，其特征在于，所述发光控制模块包括第二晶体管和第三晶体管；所述存储模块包括存储电容；所述发光模块包括发光器件；所述第二晶体管的栅极和所述第三晶体管的栅极与发光控制信号输入端连接，所述第二晶体管的第一极与所述存储电容的第一极连接，所述第二晶体管的第二极与所述驱动晶体管的栅极连接，所述第三晶体管的第一极和所述存储电容的第二极与所述驱动晶体管的第二极连接，所述第三晶体管的第二极与所述发光器件的正极连接，所述驱动晶体管的第一极与第一电源信号输入端连接，所述发光器件的负极与所述第二电源信号输入端连接。4.根据权利要求3所述的像素驱动电路，其特征在于，所述数据写入模块包括第四晶体管；所述第四晶体管的栅极与所述第一扫描信号输入端连接，所述第四晶体管的第一极与数据电压输入端连接，所述第四晶体管的第二极与所述存储电容的第一极连接。5.根据权利要求4所述的像素驱动电路，其特征在于，还包括第一初始化模块和第二初始化模块；所述第一初始化模块用于在初始化阶段对所述发光器件复位；所述第二初始化模...
【专利技术属性】
技术研发人员：韩珍珍，张金方，陶子超，
申请(专利权)人：合肥维信诺科技有限公司，
类型：发明
国别省市：
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