【技术实现步骤摘要】
非对称多核异构并行处理系统相关申请的交叉引用本申请要求2018年12月29日递交的标题为“AnAsymmetricMulti-CoreHeterogeneousParallelProcessingSystemwithContentAwareandDisplayAwareRenderingLogic”的美国临时专利申请62/786,379号的权益并且根据35U.S.C.§119(e)要求其优先权,这里通过引用将该申请全部并入。本申请也是2017年8月28日递交的标题为“AsymmetricMulti-CoreHeterogeneousParallelProcessingSystem”的美国专利申请15/687,776号的部分延续案,该美国专利申请要求2017年6月20日递交的标题为“AnAsymmetricMulti-CoreHeterogeneousParallelProcessingSystem”的美国临时专利申请62/522,172号的权益并且根据35U.S.C.§119(e)要求其优先权,这里通过引用将这些申请的每一者全部并入。 ...
【技术保护点】
1.一种非对称多核异构图形处理单元(GPU),所述多核GPU包括:/n第一组一个或多个GPU核心,其中每一者具有第一微体系结构和第一功率消耗概要,所述第一组GPU核心被配置为执行指令集体系结构(ISA)的第一子集;/n第二组一个或多个GPU核心,其中每一者具有第二微体系结构和高于所述第一功率消耗概要的第二功率消耗概要,所述第二组GPU核心被配置为执行整个所述ISA;/n通信地连接到所述第一组GPU核心和所述第二组GPU核心的控制器,所述控制器被配置为接收所述ISA的指令并且确定所述指令是应当由所述第一组GPU中的GPU执行,还是由所述第二组GPU中的GPU执行;并且/n其中 ...
【技术特征摘要】
20181229 US 62/786,379;20190718 US 16/515,1721.一种非对称多核异构图形处理单元(GPU),所述多核GPU包括:
第一组一个或多个GPU核心,其中每一者具有第一微体系结构和第一功率消耗概要,所述第一组GPU核心被配置为执行指令集体系结构(ISA)的第一子集;
第二组一个或多个GPU核心,其中每一者具有第二微体系结构和高于所述第一功率消耗概要的第二功率消耗概要,所述第二组GPU核心被配置为执行整个所述ISA;
通信地连接到所述第一组GPU核心和所述第二组GPU核心的控制器,所述控制器被配置为接收所述ISA的指令并且确定所述指令是应当由所述第一组GPU中的GPU执行,还是由所述第二组GPU中的GPU执行;并且
其中所述ISA的指令是由应用编程接口(API)生成的,所述API允许应用请求ISA指令被在所述第一组一个或多个GPU核心上或者所述第二组一个或多个GPU核心上执行。
2.如权利要求1所述的多核GPU,其中所述多核GPU还包括存储器,所述存储器中存储有当被所述多核GPU执行时配置系统进行以下操作的指令:
确定第一渲染对象和第二渲染对象之间的颜色差别;并且
响应于确定所述颜色差别低于阈值,在所述第一组一个或多个GPU核心上渲染所述第一渲染对象和/或所述第二渲染对象。
3.如权利要求1所述的多核GPU,其中所述多核GPU还包括存储器,所述存储器中存储有当被所述多核GPU执行时配置系统进行以下操作的指令:
确定渲染对象的每秒帧(fps)的数目,其中所述控制器还被配置为:如果所述fps的数目超过第一阈值,则确定所述指令应当被在所述第一组GPU核心上渲染。
4.如权利要求3所述的多核GPU,其中所述控制器还被配置为:如果所述fps的数目小于第二阈值,则确定所述指令应当被在所述第二组GPU核心上渲染。
5.如权利要求1所述的多核GPU,其中所述应用确定渲染的第一对象的计算复杂度,并且响应于所述复杂度超过第一阈值而生成ISA指令来由所述第二组GPU核心渲染所述第一对象。
6.如权利要求5所述的多核GPU,其中所述应用响应于所述复杂度小于第二阈值而生成ISA指令来由所述第一组GPU核心渲染所述第一对象。
7.如权利要求5所述的多核GPU,其中复杂度是基于渲染所述第一对象所要求的代码的行数来确定的。
8.如权利要求1所述的多核GPU,其中所述多核GPU还包括存储器,所述存储器中存储有当被所述多核GPU执行时配置系统进行以下操作的指令:
基于渲染对象的一个或多个拼块的关联xy坐标来确定所述渲染对象的移动的速率;并且
如果所述移动的速率超过第一阈值,则确定渲染指令应当被在所述第一组GPU核心上执行。
9.如权利要求8所述的多核...
【专利技术属性】
技术研发人员:乔治斯·科拉米达斯,雅科沃斯·斯塔姆利斯,乔治·西迪罗坡洛斯,
申请(专利权)人:畅想芯科有限公司,
类型:发明
国别省市:希腊;GR
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