【技术实现步骤摘要】
移位寄存器、栅极驱动电路及显示面板
本专利技术属于显示
,具体涉及一种移位寄存器、栅极驱动电路及显示面板。
技术介绍
GOA(GateDriveronArray,集成栅极驱动电路)技术可以将栅极驱动电路集成在显示面板的阵列基板上,替代由外接硅片制作的驱动芯片,可以省掉GateIC(GateIntegratedCircuit,栅极驱动集成电路)部分以及扇出型(Fan-out)布线空间,以简化显示产品的结构。
技术实现思路
本专利技术旨在至少解决现有技术中存在的技术问题之一,提供一种移位寄存器、栅极驱动电路及显示面板。第一方面,本专利技术实施例提供一种移位寄存器,其包括:输入子电路和第一输出子电路;所述输入子电路被配置为响应于输入信号,并通过第一电源电压对上拉节点进行预充电;所述上拉节点为所述输入子电路、所述输出子电路及所述下拉子电路之间的连接节点;所述输出子电路被配置为响应于所述上拉节点的电位,而将时钟信号通过第一信号输出端进行输出;其中,所述移位寄存器还包括:第一降噪 ...
【技术保护点】
1.一种移位寄存器,其包括:输入子电路和第一输出子电路;/n所述输入子电路被配置为响应于输入信号,并通过第一电源电压对上拉节点进行预充电;所述上拉节点为所述输入子电路、所述输出子电路及所述下拉子电路之间的连接节点;/n所述输出子电路被配置为响应于所述上拉节点的电位,而将时钟信号通过第一信号输出端进行输出;其中,/n所述移位寄存器还包括:第一降噪子电路和/或第二降噪子电路;/n所述第一降噪子电路被配置为响应于第一降噪控制信号,并在消隐阶段通过非工作电平信号,对所述上拉节点进行降噪;/n所述第二降噪子电路被配置为响应于第二降噪控制信号,并在消隐阶段通过非工作电平信号,对所述第一 ...
【技术特征摘要】
1.一种移位寄存器,其包括:输入子电路和第一输出子电路;
所述输入子电路被配置为响应于输入信号,并通过第一电源电压对上拉节点进行预充电;所述上拉节点为所述输入子电路、所述输出子电路及所述下拉子电路之间的连接节点;
所述输出子电路被配置为响应于所述上拉节点的电位,而将时钟信号通过第一信号输出端进行输出;其中,
所述移位寄存器还包括:第一降噪子电路和/或第二降噪子电路;
所述第一降噪子电路被配置为响应于第一降噪控制信号,并在消隐阶段通过非工作电平信号,对所述上拉节点进行降噪;
所述第二降噪子电路被配置为响应于第二降噪控制信号,并在消隐阶段通过非工作电平信号,对所述第一信号输出端进行降噪。
2.根据权利要求1所述的移位寄存器,其中,所述第一降噪子电路包括第一晶体管;
所述第一晶体管的第一极连接所述上拉节点,第二极连接非工作电平端,控制极连接第一降噪控制信号端。
3.根据权利要求1所述的移位寄存器,其中,所述第二降噪子电路包括第二晶体管;
所述第二晶体管的第一极连接所述第一信号输出端,第二极连接非工作电平端,控制极连接第二降噪控制信号端。
4.根据权利要求1所述的移位寄存器,其中,所述移位寄存器还包括多个第二输出子电路;
所述多个第二输出子电路中的每个被配置为响应于与之对应的开关控制信号,而将所述第一信号输出端输出的信号通过与之对应的第二信号输出端输出。
5.根据权利要求4所述的移位寄存器,其中,所述N个第二输出子电路中的每个均包括第三晶体管;
所述第三晶体管的第一极连接所述第一信号输出端,第二极连接所述第二信号输出端,控制极连接开关控制信号端。
6.根据权利要求1所述的移位寄存器,其中,所述移位寄存器还包括多个第二输出子电路;
所述多个第二输出子电路中的每个被配置为响应于所述第一信号输出端输出的信号,而将驱动信号通过与之对应的第二信号输出端输出。
7.根据权利要求6所述的移位寄存器,其中,所述多个第二输出子电路中的每个均包括第三晶体管;
所述第三晶体管的第一极连接与之对应的驱动信号端,第二极连接所述第二信号输出端,控制极连接所述第一信号输出端。
8.根据权利要求4-7中任一项所述的移位寄存器,其中,所述移位寄存器还包括下拉控制子电路、下拉子电路、第三降噪子电路、第四降噪子电路;
所述下拉控制子电路被配置为响应于工作电平信号,并将所述工作电平信号传输至下拉节点;所述下拉节点为所述下拉控制子电路和所述下拉子电路之间的连接节点;
所述下拉子电路被配置为响应于所述上拉节点的电位,通过非工作电平信号下拉所述下拉节点的电位;
所述第三降噪子电路被配置为响应于所述下拉节点的电位,通过所述非工作电平信号对所述上拉节点进行降噪;
所述第四降噪子电路被配置为响应于所述下拉节点的电位,通过所述非工作电平信号对所述第一信号输出端进行降噪。
9....
【专利技术属性】
技术研发人员:古宏刚,陈俊生,宋洁,
申请(专利权)人:合肥京东方光电科技有限公司,京东方科技集团股份有限公司,
类型:发明
国别省市:安徽;34
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