【技术实现步骤摘要】
一种信号采集子卡工作系统
本技术涉及信号处理领域，特别是一种信号采集子卡工作系统。
技术介绍
传统的数据采集卡多使用具有CMOS和LVDS接口规范的ADC芯片，其数据输出速率局限在1Gbps，随着对模数转换的分辨率和采样速度的要求越来越高，数据采集迫切需要使用具有更高传输速率以及更高效率的输出接口的ADC芯片。此外，随着采样通道数量的增加，使用CMOS和LVDS接口规范的ADC芯片在多器件多通道之间的数据同步，以及PCBlayout等方面都难以实现。最后，使用CMOS和LVDS接口规范的ADC其输出链路上数据的时延存在不确定性，即从输入信号采样边沿的时刻直至ADC输出数字这段时间内的时钟周期数是不确定的。对相位非常敏感的应用，例如对于相控阵雷达方面的应用，必须确保ADC在两个上电周期之间以及链路重新同步期间，其延时是确定的以及可重现的，现有的使用具有CMOS和LVDS接口规范的ADC芯片的数据采集卡无法满足该需求。
技术实现思路
为解决上述问题，本技术的目的在于提供一种信号采集子卡工作系统，其能够实现高速高精...
【技术保护点】
1.一种信号采集子卡工作系统，其特征在于，包括FMC载卡模块(10)以及与所述载卡模块连接的子板模块(20)，所述子板模块(20)包括有源晶振(21)、与所述有源晶振(21)连接的时钟发生器(22)、与所述时钟发生器(22)连接的至少一个ADC芯片(23)以及分别与所述ADC芯片(23)和所述时钟发生器(22)连接的FMC连接器插头(24)，所述FMC载卡模块(10)包括与所述FMC连接器插头(24)相对应可插拔连接的FMC连接器插座(11)以及与所述FMC连接器插座(11)连接的FPGA芯片(12)，所述ADC芯片(23)依次通过所述FMC连接器插头(24)和所述FMC连...
【技术特征摘要】
1.一种信号采集子卡工作系统，其特征在于，包括FMC载卡模块(10)以及与所述载卡模块连接的子板模块(20)，所述子板模块(20)包括有源晶振(21)、与所述有源晶振(21)连接的时钟发生器(22)、与所述时钟发生器(22)连接的至少一个ADC芯片(23)以及分别与所述ADC芯片(23)和所述时钟发生器(22)连接的FMC连接器插头(24)，所述FMC载卡模块(10)包括与所述FMC连接器插头(24)相对应可插拔连接的FMC连接器插座(11)以及与所述FMC连接器插座(11)连接的FPGA芯片(12)，所述ADC芯片(23)依次通过所述FMC连接器插头(24)和所述FMC连接器插座(11)与所述FPGA芯片(12)相连接。
2.根据权利要求1所述的一种信号采集子卡工作系统，其特征在于，所述ADC芯片(23)与所述FPGA芯片(12)之间的连接协议为JESD204B协议。
3.根据权利要求1所述的一种信号采集子卡工作系统，其特征在于，所述时钟发生器(22)包括第一时钟输出端(221)、第一SYSREF输出端(222)、第二时钟输出端(223)以及第二SYSREF输出端(224)，所述ADC芯片(23)包括第一时钟接收端(231)以及第一信号接收端(232)，所述FMC连接器插头(24)包括第二时钟接收端(241)以及第二信号接收端(242)，所述第一时钟输出端(221)与所述第一时钟接收端(231)连接，所述第一SYSREF输出端(222)与所述第一信号接收端(232)连接，所述第二时钟输出端(223)与所述第二时钟接收端(241)连接，所述第二SYSREF输出端(224)与所述第二信号接收端(242)连接。
4.根据权利要求2所述的一种信号采集子卡工作系统，其特征在于：所述FMC连接器插头(24...
【专利技术属性】
技术研发人员：包晓军，王育才，李琳，刘会涛，刘远曦，刘航，黄辉，
申请(专利权)人：珠海纳睿达科技有限公司，
类型：新型
国别省市：广东;44
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