The utility model provides a data error proofing device for a merging unit, which comprises an analog data acquisition loop, a DSP, a FPGA and a physical interface chip. The analog data acquisition loop comprises a first analog acquisition loop and a second analog acquisition loop, wherein the DSP comprises a first DSP and a second DSP, and the first DSP connects the first analog acquisition loop, and the second DSP connects the second analog circuit. The FPGA is respectively connected with the first DSP, the second DSP and the physical interface chip, and the FPGA is provided with a comparison circuit. The utility model is based on the double data flow to prevent the data in each link of the merging unit from misoperation of a large area of protection control equipment once the error occurs.
【技术实现步骤摘要】
一种合并单元数据防误装置
本技术属于智能变电站继电保护
,具体涉及一种合并单元数据防误装置。
技术介绍
随着器件加工工艺向深亚微米门信号宽度迈进,存储器产品的单元尺寸继续缩小,从而导致电压越来越低(5V→3.3V→1.8V→1.2V……)以及存储单元内部电容越来越小(10fF→5fF……)。由于电容的减小,存储器件中的临界电荷量(一个存储单元用于保存数据所需的最小电荷量)继续缩小,因而使得它们对软误差率的自然抵御能力下降,这反过来又意味着能量低得多的α等高能粒子,都有可能对存储单元形成干扰,由此出现软错误。图3是现有的合并单元的架构,DSP负责就地采样、级联数据接收和同步、合并等计算;FPGA完成以太网数据包的接收和发送等处理工作;在AD采样环节,目前大多的方案基本都采用了保护电流采样双重化的方案,但数据处理的核心器件DSP和FPGA则采用了单重化的方式。由于当前DSP和FPGA器件的集成度很高,因此发生软错误的概率大大增加,这就是当前多个变电站合并单元数据出错导致大范围保护误动的主要原因。
技术实现思路
本技术的目的是提供一种合并单元数据防误装置,基于双数据流对合并单元各个环节数据防误,防止一旦出错引起大面积的保护控制设备误动。本技术提供了如下的技术方案:一种合并单元数据防误装置,包括模拟量采集回路、DSP、FPGA和物理接口芯片,所述模拟量采集回路包括第一模拟量采集回路和第二模拟量采集回路,所述DSP包括第一DSP和第二DSP,所述第一DSP连接所述第一模拟采集回路,所述第二DSP连接所述第二模拟量采集回路,所述FPGA分别连接所述第一DSP、所述第二D ...
【技术保护点】
1.一种合并单元数据防误装置,其特征在于,包括模拟量采集回路、DSP、FPGA和物理接口芯片,所述模拟量采集回路包括第一模拟量采集回路和第二模拟量采集回路,所述DSP包括第一DSP和第二DSP,所述第一DSP连接所述第一模拟采集回路,所述第二DSP连接所述第二模拟量采集回路,所述FPGA分别连接所述第一DSP、所述第二DSP和所述物理接口芯片,所述FPGA内设有比较电路;所述第一DSP和所述第二DSP用于接收来自所述模拟量采集回路和所述FPGA的数据并将数据进行插值同步处理,同时将处理的模拟量采集回路数据发送至所述FPGA;所述FPGA用于将接收的数据自行拷贝形成双份数据分为两份完全对等的数据流,对每份数据流同步进行数据包的处理,将来自所述物理接口芯片的数据包分别推送至所述第一DSP和所述第二DSP,所述比较电路对来自DSP的数据包进行完全比对,将比对结果一致的数据发送至所述物理接口芯片。
【技术特征摘要】
1.一种合并单元数据防误装置,其特征在于,包括模拟量采集回路、DSP、FPGA和物理接口芯片,所述模拟量采集回路包括第一模拟量采集回路和第二模拟量采集回路,所述DSP包括第一DSP和第二DSP,所述第一DSP连接所述第一模拟采集回路,所述第二DSP连接所述第二模拟量采集回路,所述FPGA分别连接所述第一DSP、所述第二DSP和所述物理接口芯片,所述FPGA内设有比较电路;所述第一DSP和所述第二DSP用于接收来自所述模拟量采集回路和所述FPGA的数据并将数据进行插值同步处理,同时将处理的模拟量采集回路数据发送至所述FPGA;所述FPGA用于将接收的数据自行拷贝形成双份数据分为两份完全对等的数据流,对每份数据流同步进行数据包的处理,将来自所述物理接口芯片的数据包分别推送至所述第一DSP和所述第二DSP,所述比较电路对来自DSP的数据包进行完全比对,将比对结果一致的数据发送至所述物理接口芯片。2.根据权利要求1所述的一种合并单元数据防误装置,其特征在于,所述模拟量采集回路为对CT、PT模拟量进行...
【专利技术属性】
技术研发人员:崔玉,冯亚东,吴奕,曹海欧,朱继红,张玥,侯永春,吴昊,
申请(专利权)人:国网江苏省电力有限公司,南京合智电力科技有限公司,
类型:新型
国别省市:江苏,32
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