The invention discloses a differential LVDS test device with adjustable amplitude and frequency, including PC, data control module, data processing module, numerical control variable gain differential amplifier, LVDS interface, DMD chip and oscilloscope; the invention adopts programmability of programmable logic device of FPGA, and reads the control signal from ROM storage module by communicating with C ortex M7 processor and PC. According to the configuration data, the differential LVDS signals of corresponding frequencies can be generated; at the same time, the amplitude configuration data can be read from ROM storage module by the same method, and the amplitude of differential LVDS can be adjusted by configuring NC variable gain differential amplifier, and the test through LVDS channel of DMD chip can be obtained by using oscilloscope or programmable logic device of FPGA. Data to verify the performance of the LVDS channel. The whole test device has the characteristics of simple operation, low cost, compact and portable equipment. The DMD chip in this test device can be replaced by other chips, and the whole test device has high configurability.
【技术实现步骤摘要】
一种幅度频率可调的差分LVDS测试装置
本专利技术涉及IC测试
中对差分LVDS的测试,尤其是一种幅度频率可调的差分LVDS测试装置。
技术介绍
在IC测试中,差分LVDS信号测试一直是一项十分重要的测试内容。芯片制造者需要对于自己制作的芯片中LVDS通道的性能进行有效及快速地测试,此时可控的差分LVDS的测试装置就变得尤为重要。但是传统的测试方式是利用特殊的信号发生器产生差分信号,一般信号发生器不具有差分信号产生的条件,而可以产生差分信号的信号发生器本身具有造价贵,难以搬运等缺点,并且频率可能受限制,无法进行自定义的设置。
技术实现思路
本专利技术的目的是针对现有技术的不足而提供的一种幅度频率可调的差分LVDS测试装置,通过FPGA可编程逻辑器件的可编程性,通过与Cortex-M7处理器和PC机的通信,得到控制信号后从ROM存储模块读取频率配置数据,根据配置数据可以产生相应频率的差分LVDS信号;同时,使用相同的方法从ROM存储模块读取幅度配置数据,通过配置数控可变增益差分放大器,进行对于差分LVDS幅度的调整,并通过使用示波器或者FPGA可编程逻辑器件得到通过DMD芯片LVDS通道后的测试数据,验证该LVDS通道的性能。整个测试装置具有操作简单、造价低、设备小巧便携等特点。本测试装置中的DMD芯片可以换成其他芯片,整个测试装置可配置性高。实现本专利技术目的的具体技术方案是:一种幅度频率可调的差分LVDS测试装置,其特点包括PC机、数据控制模块、数据处理模块、数控可变增益差分放大器、LVDS接口、DMD芯片及示波器;所述PC机与数据控制模块连接;数据控 ...
【技术保护点】
1.一种幅度频率可调的差分LVDS测试装置,其特征在于,该装置包括PC机(1)、数据控制模块(2)、数据处理模块(3)、数控可变增益差分放大器(4)、LVDS接口(5)、DMD芯片(6)及示波器(7);所述PC机(1)与数据控制模块(2)连接;数据控制模块(2)与数据处理模块(3)连接;数据处理模块(3)分别与数控可变增益差分放大器(4)及DMD芯片(6)连接;数控可变增益差分放大器(4)与LVDS接口(5)连接;LVDS接口(5)与DMD芯片(6)连接;DMD芯片(6)与示波器(7)连接;所述数据控制模块(2)由Cortex‑M7处理器(21)、IIC接口(22)、J‑LINK接口(23)及USB接口(24)构成,其中,Cortex‑M7处理器(21)分别与IIC接口(22)、J‑LINK接口(23)及USB接口(24)连接;所述数据处理模块(3)由FPGA可编程逻辑器件(31)、LED灯(32)、按键(33)、IIC接口(34)、ROM存储模块(35)及JTAG接口(36)构成,其中,FPGA可编程逻辑器件(31)分别与LED灯(32)、按键(33)、IIC接口(34)、ROM存储 ...
【技术特征摘要】
1.一种幅度频率可调的差分LVDS测试装置,其特征在于,该装置包括PC机(1)、数据控制模块(2)、数据处理模块(3)、数控可变增益差分放大器(4)、LVDS接口(5)、DMD芯片(6)及示波器(7);所述PC机(1)与数据控制模块(2)连接;数据控制模块(2)与数据处理模块(3)连接;数据处理模块(3)分别与数控可变增益差分放大器(4)及DMD芯片(6)连接;数控可变增益差分放大器(4)与LVDS接口(5)连接;LVDS接口(5)与DMD芯片(6)连接;DMD芯片(6)与示波器(7)连接;所述数据控制模块(2)由Cortex-M7处理器(21)、IIC接口(22)、J-LINK接口(23)及USB接口(24)构成,其中,Cortex-M7处理器(21)分别与IIC接口(22)、J-LINK接口(23)及USB接口(24)连接;所述数据处理模块(3)由FPGA可编程逻辑器件(31)、LED灯(3...
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