一种端口检测和状态锁存电路制造技术

本实用新型专利技术涉及集成电路技术领域，具体涉及一种端口检测和状态锁存电路，包括外部管脚部分，通过接不同阻抗电阻到地实现多种状态；与所述外部管脚部分连接的管脚阻抗检测部分，通过检测外部管脚的阻抗，形成反映该阻抗的电压，输出给后面的比较选择部分进行比较；与所述比较选择部分连接的逻辑锁存部分，将数字逻辑信号保存住，传输给电路中其他功能模块以实现选择相应的功能或者参数状态的功能；本实用新型专利技术采用上述结构，一方面可以通过单一端口实现多种功能或状态的选择；另一方面，该电路启动时的检测技术极大地提高了电路的抗干扰能力，增强了电路系统的稳定性；同时又能不增加芯片正常工作时的功耗。

【技术实现步骤摘要】
一种端口检测和状态锁存电路
本技术涉及集成电路
，具体涉及一种集成电路中端口的检测和状态锁存的方法，用以实现不同功能和状态的选择切换的端口检测和状态锁存电路。
技术介绍
在集成电路中，有时需要在一个电路中实现多种功能的切换选择、或者同一功能下不同参数状态的切换选择，而这样的切换选择通常通过功能选择管脚以及相应的状态控制电路实现。在实际应用中，常通过功能选择管脚接电路高、低电平，或者不同的电阻分压等形式来实现。如图1所示，为目前常见的一种状态选择电路，功能选择管脚A连接一个施密特触发器，通过A接电路地和接电路高电平VDD就能实现两种不同状态，然后通过信号Yn传输到后面的控制电路，实现最终的功能选择。这种方式结构简单，但一个管脚只能有2种状态(高电平和低电平)，如果需要多种状态就需要增加管脚进行逻辑组合，增加了电路的管脚和控制的复杂度。图2所示，为图1的另外一种形式，功能选择管脚B内部上拉了电阻R_up到电源VDD，施密特触发器也可以换成反相器，这样功能选择管脚B通过接地和悬空实现两种状态。图3所示，为另外一种状态选择电路的实现方法，功能选择管脚C检测外部电阻R1和R2分压而形成的电压VC，比较器将VC和内部基准电压V1～V3进行比较，根据不同的VC电压实现不同的Y状态输出，从而根据分压电阻R1和R2的比例实现多种状态的选择控制。这种方式只要一个端口就可以实现多种状态，但外部分压电阻增加了功耗也增加了系统成本，且电压VC容易受外部环境(比如潮湿，漏电，高温影响等)因素影响导致状态误检测，影响系统的稳定性。
技术实现思路
本技术的目的是提供一种在电路启动时检测对应管脚端口的阻抗，通过内部比较判断后形成数字逻辑并锁存住，在电路正常工作时可以以此逻辑状态选择相应的工作模式或者参数的端口检测和状态锁存电路。为了解决
技术介绍
所存在的问题，本技术是采用以下技术方案：一种端口检测和状态锁存电路，包括外部管脚部分，通过接不同阻抗电阻到地实现多种状态；与所述外部管脚部分连接的管脚阻抗检测部分，通过检测外部管脚的阻抗，形成反映该阻抗的电压，输出给后面的比较选择部分进行比较；与所述比较选择部分连接的逻辑锁存部分，将数字逻辑信号保存住，传输给电路中其他功能模块以实现选择相应的功能或者参数状态的功能；所述管脚阻抗检测部分、比较选择部分和逻辑锁存部分均接有启动信号Start进行启动控制。进一步地，所述管脚阻抗检测部分包括电源Vdd、控制开关K和电流源I1，所述电源Vdd通过控制开关K与电流源I1连接。进一步地，所述比较选择部分包括第一比较器comp1、第二比较器comp2和第三比较器comp3，所述第一比较器comp1、第二比较器comp2和第三比较器comp3的正端均接比较电平V1，负端分别接第一基准比较电压Vref_1、第二基准比较电压Vref_2和第三基准比较电压Vref_3。进一步地，所述逻辑锁存部分包括第一RS触发器、第二RS触发器和第三RS触发器，所述第一RS触发器的S端接所述第一比较器comp1的输出端，所述第二RS触发器的S端接所述第二比较器comp2的输出端，所述第三RS触发器的S端接所述第三比较器comp3的输出端，所述第一RS触发器、第二RS触发器和第三RS触发器R端均接Start信号。本技术具有以下有益效果：本技术所述的一种端口检测和状态锁存电路，包括外部管脚部分，通过接不同阻抗电阻到地实现多种状态；与所述外部管脚部分连接的管脚阻抗检测部分，通过检测外部管脚的阻抗，形成反映该阻抗的电压，输出给后面的比较选择部分进行比较；与所述比较选择部分连接的逻辑锁存部分，将数字逻辑信号保存住，传输给电路中其他功能模块以实现选择相应的功能或者参数状态的功能；本技术采用上述结构，一方面可以通过单一端口实现多种功能或状态的选择；另一方面，该电路启动时的检测技术极大地提高了电路的抗干扰能力，增强了电路系统的稳定性；同时又能不增加芯片正常工作时的功耗。附图说明图1是
技术介绍
中第一种状态选择电路图。图2是
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中第二种状态选择电路图。图3是
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中第三种状态选择电路图。图4是本技术的结构框图。图5是本技术的电路图。图6是Start和Normal信号的时序关系图。具体实施方式参照图4-图6，本具体实施方式采用以下技术方案：一种端口检测和状态锁存电路，包括外部管脚部分1，通过接不同阻抗电阻到地(包括短路和开路)实现多种状态，可以根据实际需要进行选择；与所述外部管脚部分1连接的管脚阻抗检测部分2，通过检测外部管脚的阻抗，形成反映该阻抗的电压，输出给后面的比较选择部分3进行比较，从而形成代表不同管脚状态的数字逻辑信号；阻抗检测可以采用内部电流源向外部管脚的电阻灌电流的方式，选择比较部分可以采用常规比较器构成；与所述比较选择部分3连接的逻辑锁存部分4，将数字逻辑信号保存住，传输给电路中其他功能模块以实现选择相应的功能或者参数状态的功能；逻辑锁存部分4可以采用RS触发器构成；所述管脚阻抗检测部分2、比较选择部分3和逻辑锁存部分4均接有启动信号Start进行启动控制，在电路启动或者重启后对模块进行清零处理，重新检测外部管脚状态。上述电路只有在电路启动或者重启时进行阻抗检测和逻辑锁存，检测功能只维持一定时间，一旦电路系统正常工作后，检测和比较部分都关闭，不会给电路带来额外功耗；同时在阻抗检测时，检测电流较大，有效地降低该外部管脚受到PCB潮湿漏电、高温环境、PCB板材质量等外部因素的干扰影响，提高了电路的稳定性。具体的，所述管脚阻抗检测部分2包括电源Vdd、控制开关K和电流源I1，所述电源Vdd通过控制开关K与电流源I1连接。具体的，所述比较选择部分3包括第一比较器comp1、第二比较器comp2和第三比较器comp3，所述第一比较器comp1、第二比较器comp2和第三比较器comp3的正端均接比较电平V1，负端分别接第一基准比较电压Vref_1、第二基准比较电压Vref_2和第三基准比较电压Vref_3。具体的，所述逻辑锁存部分4包括第一RS触发器5、第二RS触发器6和第三RS触发器7，所述第一RS触发器5的S端接所述第一比较器comp1的输出端，所述第二RS触发器6的S端接所述第二比较器comp2的输出端，所述第三RS触发器7的S端接所述第三比较器comp3的输出端，所述第一RS触发器5、第二RS触发器6和第三RS触发器7的R端均接Start信号。在本实施例中，该电路启动时，内部启动信号Start控制开关K开启，向端口SEL灌入电流I1，形成比较电压V1＝I1*R。比较选择部分可由多个比较器构成，图5实施例为3个，用以实现4种状态检测；比较器的正端都接比较电平V1，负端接基准比较电压Vref_1,Vref_2,Vref_3,其中基准比较电压是由电路内部其他功能模块生成，比如基准分压而成，一般该基准比较电压按照由大而小或者由小而大顺序设置，此方案假设Vref_1<Vref_2<Vref_3；那么当Vref_1<V1<Vref_2时，比较器comp1翻转，输出高电平,而其他2个比较器不翻转，输出低电平，此时C1C2C3＝100；当V1&a本文档来自技高网...

【技术保护点】
一种端口检测和状态锁存电路，其特征在于，包括外部管脚部分1，通过接不同阻抗电阻到地实现多种状态；与所述外部管脚部分(1)连接的管脚阻抗检测部分(2)，通过检测外部管脚的阻抗，形成反映该阻抗的电压，输出给后面的比较选择部分(3)进行比较；与所述比较选择部分(3)连接的逻辑锁存部分(4)，将数字逻辑信号保存住，传输给电路中其他功能模块以实现选择相应的功能或者参数状态的功能；所述管脚阻抗检测部分(2)、比较选择部分(3)和逻辑锁存部分(4)均接有启动信号Start进行启动控制。

【技术特征摘要】
1.一种端口检测和状态锁存电路，其特征在于，包括外部管脚部分1，通过接不同阻抗电阻到地实现多种状态；与所述外部管脚部分(1)连接的管脚阻抗检测部分(2)，通过检测外部管脚的阻抗，形成反映该阻抗的电压，输出给后面的比较选择部分(3)进行比较；与所述比较选择部分(3)连接的逻辑锁存部分(4)，将数字逻辑信号保存住，传输给电路中其他功能模块以实现选择相应的功能或者参数状态的功能；所述管脚阻抗检测部分(2)、比较选择部分(3)和逻辑锁存部分(4)均接有启动信号Start进行启动控制。2.根据权利要求1所述的一种端口检测和状态锁存电路，其特征在于，所述管脚阻抗检测部分(2)包括电源Vdd、控制开关K和电流源I1，所述电源Vdd通过控制开关K与电流源I1连接。3.根据权利要求1所述的一种端口检测和状态锁存电路，其特征在于，所述比...

【专利技术属性】
技术研发人员：冯艳，高杰，王广武，李振东，刘杰锋，贺先要，
申请(专利权)人：长沙韶光半导体有限公司，
类型：新型
国别省市：湖南,43