The invention discloses a FPGA accelerator and control method based on AdaBoost algorithm, AdaBoost algorithm including FPGA FPGA accelerator and micro control unit based on FPGA, including the micro control unit is connected respectively with the parameters of RAM and RAM, and RAM image parameters connected for converting parameters for simplified parameter conversion complete the parameter feature parameters and parameter conversion module, conversion module is connected with the image of the RAM are respectively connected and used to calculate the required value in the image of RAM data in the location address generation module, and image RAM is connected and used to calculate the cumulative multiple operation and accumulation module, micro control unit and a plurality of operation accumulation module connected and used for the entire accelerator cycle control and finally calculate the output of the loop control module. In the case of sufficient resources, a number of different arithmetic accumulation modules can be instantiated to speed up the operation.
【技术实现步骤摘要】
一种基于FPGA的AdaBoost算法加速器及控制方法
本专利技术涉及FPGA和AdaBoost算法领域,尤其涉及一种基于FPGA的AdaBoost算法加速器及控制方法。
技术介绍
FPGA(FieldProgrammableGateArray,可编辑逻辑门阵列)广泛的应用于各种电子和控制领域,FPGA的主要功能就是灵活的实现高速计算和控制。Adaboost是一种迭代算法,其核心思想是针对同一个训练集训练不同的分类器(弱分类器),然后把这些弱分类器集合起来,构成一个更强的最终分类器(强分类器)。为了实现AdaBoost算法加速的功能,使用FPGA来实现。使用FPGA进行并行计算和加速是当下较为常见的解决方案。然而现有技术中,AdaBoost算法在中央处理器(CPU)和其他处理器上实现速度较慢,目前为止还没有很好的解决方法。
技术实现思路
为了解决上述的技术问题,本专利技术的目的在于提出一种基于FPGA的AdaBoost算法加速器及控制方法,能够实现计算的并行化,极大地加快运算速度。为了达到上述目的,本专利技术提供了一种技术方案:一种基于FPGA的AdaBoost算法加速器,包括FPGA和微控制单元,FPGA包括分别与微控制单元相连接的参数RAM和图像RAM、与参数RAM相连接且用于转换参数使被简化的参数转换为完整的参数特征的参数转换模块、与参数转换模块相连接和图像RAM分别相连接且用于计算所需要的值在图像RAM数据中的位置的地址产生模块、与图像RAM相连接且用于累加计算的多个运算累加模块、与微控制单元和多个运算累加模块分别相连接且用于整个加速器的循环控制和最后 ...
【技术保护点】
一种基于FPGA的AdaBoost算法加速器,其特征在于:包括FPGA和微控制单元,所述的FPGA包括分别与所述微控制单元相连接的参数RAM和图像RAM、与所述参数RAM相连接且用于转换参数使被简化的参数转换为完整的参数特征的参数转换模块、与所述参数转换模块相连接和图像RAM分别相连接且用于计算所需要的值在所述图像RAM数据中的位置的地址产生模块、与所述图像RAM相连接且用于累加计算的多个运算累加模块、与所述微控制单元和多个运算累加模块分别相连接且用于整个加速器的循环控制和最后计算的输出的循环控制模块。
【技术特征摘要】
1.一种基于FPGA的AdaBoost算法加速器,其特征在于:包括FPGA和微控制单元,所述的FPGA包括分别与所述微控制单元相连接的参数RAM和图像RAM、与所述参数RAM相连接且用于转换参数使被简化的参数转换为完整的参数特征的参数转换模块、与所述参数转换模块相连接和图像RAM分别相连接且用于计算所需要的值在所述图像RAM数据中的位置的地址产生模块、与所述图像RAM相连接且用于累加计算的多个运算累加模块、与所述微控制单元和多个运算累加模块分别相连接且用于整个加速器的循环控制和最后计算的输出的循环控制模块。2.根据权利要求1所述的基于FPGA的AdaBoost算法加速器,其特征在于:所述的循环控制模块包括控制整个加速器循环过程的状态机。3.根据权利要求1所述的基于FPGA的AdaBoost算法加速器,其特征在于:所述的参数转换模块和地址产生模块分别具有定制的逻辑电路。4.根据权利要求1所述的基于FPGA的AdaBoost算法加速器,其特征在于:所述的运算累加模块为仅受到一根信号线控制的乘加...
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