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本发明公开了一种嵌入式计算机系统内存数据校验电路，中央处理器的总线地址线分别与第一静态随机存储器和第二静态随机存储器连接；中央处理器的总线数据线与第一静态随机存储器和可编程逻辑器连接，并经过可编程逻辑器后与第二静态随机存储器连接，通过总线数...
该专利属于浙江中控技术股份有限公司所有，仅供学习研究参考，未经过浙江中控技术股份有限公司授权不得商用。

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