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本发明公开了一种基于高速串行总线的DMA结构的pipeline读写方法，主机通过DCR设置DMA寄存器，TX状态机根据设置依次循环发送读描述符，读数据和写描述符请求，然后由端口状态机控制完成上述各种请求，端口状态机通过LIS总线发出读或写操...
该专利属于无锡众志和达存储技术股份有限公司所有，仅供学习研究参考，未经过无锡众志和达存储技术股份有限公司授权不得商用。

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