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本发明抑制在采样和保持时段期间与开关操作相关联的电荷注入的变化。本技术的成像元件包括像素阵列部和对应于像素阵列部的像素行而设置的采样保持电路。采样保持电路包括：第一电容元件和第二电容元件；第一采样晶体管和第二采样晶体管，分别串联连接至第一电...
该专利属于索尼半导体解决方案公司所有，仅供学习研究参考，未经过索尼半导体解决方案公司授权不得商用。

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