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本发明提供一种支持浮点数尾数乘法的存算一体乘法器，其至少包括译码阵列、存储器以及加法阵列，利用该乘法器进行乘法运算时，被乘数以部分积的形式配置在存储器内，乘数以特定位宽为单位划分成片段，以片段为单位串行地加载到译码阵列输入端，直到完成一个完...
该专利属于复旦大学所有，仅供学习研究参考，未经过复旦大学授权不得商用。

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