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本发明公开了ＳＲＡＭ型ＦＰＧＡ数字时序电路在线检测容错系统及方法。本发明中被检测容错的时序电路分割为组合逻辑和时序逻辑，分别先后对组合逻辑和时序逻辑进行三模冗余和多数表决掩盖故障，得到冗余时序电路；冗余时序电路在物理结构上分为三个独立的动态...
该专利属于电子科技大学所有，仅供学习研究参考，未经过电子科技大学授权不得商用。

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