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一种计算机微处理器设计技术领域的基于ＦＰＧＡ的通用矩阵浮点乘法器，包括：若干并行的矩阵浮点乘法器，每个矩阵浮点乘法器包括：控制管理模块、运算模块和存储模块，其中：控制管理模块包括：数据地址控制子模块、结果有效控制子模块和累加器清零控制子模块...
该专利属于上海交通大学所有，仅供学习研究参考，未经过上海交通大学授权不得商用。

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