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本发明涉及用于验证电路的模型检测中的模型抽象方法和系统，所述电路由Ｖｅｒｉｌｏｇ设计，所述方法包括：步骤１，读入所述电路的Ｖｅｒｉｌｏｇ代码，依据检测需求处理所述Ｖｅｒｉｌｏｇ代码中的变量，以规范并简化所述代码；步骤２，根据规范后的所述变量...
该专利属于中国科学院计算技术研究所所有，仅供学习研究参考，未经过中国科学院计算技术研究所授权不得商用。

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