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本发明涉及一种基于FPGA可配置、易提升并行度的卷积神经网络加速方法，属于深度学习领域，包括以下步骤：S1：在ARM端将数据进行重排，存入外部存储DDR；S2：FPGA接受到ARM发出的开始计算指令之后，FPGA通过突发传输方式读取DDR中...
该专利属于重庆邮电大学所有，仅供学习研究参考，未经过重庆邮电大学授权不得商用。

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