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一种基于FPGA和DAC的实时可重构通用忆阻器仿真方法技术
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文档序号:35106398
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本发明公开了一种基于FPGA的实时可重构通用忆阻器仿真方法,将忆阻器数学模型通过m项多项式进行非线性拟合,其中m与输入信号的幅度和频率及拟合精度有关,这样通过更新多项式的阶次、多项式系数和采样间隔即可简单快速地适配指定的忆阻器模型。在此基础...
该专利属于电子科技大学所有,仅供学习研究参考,未经过电子科技大学授权不得商用。
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