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锁相环电路制造技术
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文档序号:3419476
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一种锁相环(PLL)电路,其中基准信号源(1)和电压控制振荡器(VCO)电路(3)的输出分别被分频器电路(2,4)分频。提供相位比较器(5)用于输出表示这些信号之间的误差信号。提供窗口发生器电路(9)用于输出窗口信号;低通滤波器(LPF)电...
该专利属于日本精密电路株式会社所有,仅供学习研究参考,未经过日本精密电路株式会社授权不得商用。
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