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大规模半导体逻辑器件制造技术
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文档序号:3413422
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多相位时钟信号从时钟信号输入针通过至少三级缓冲电路传送到分散在芯片上的大量负载电路。第一级缓冲电路设置在输入针附近,而第二级缓冲电路设置在芯片的中心部分。在接连的两级缓冲电路之间进行等长度布线,并且对应于各相位的某级缓冲电路中的每一个连接相...
该专利属于株式会社日立制作所所有,仅供学习研究参考,未经过株式会社日立制作所授权不得商用。
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