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公开了一种ＰＬＤ，这种ＰＬＤ通过提供比组合输出更多的寄存输出和／或可以驱动多于一个寄存器的组合输出使每个逻辑模块具有更多触发器。所述ＰＬＤ包括排列在阵列中的多个逻辑阵列块和互连所述阵列的所述阵列的所述逻辑阵列块的多个逻辑阵列块互连线。至少一...
该专利属于阿尔特拉公司所有，仅供学习研究参考，未经过阿尔特拉公司授权不得商用。

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