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一种高速读出放大器，其保证高的集成度并可抑制能耗的上升及即使在高集成度情况下速度的降低。与一静态型ＲＡＭ的存储单元的数据相连接的成对位线通过ＭＯＳ晶体管与一对共用数据线相连，一对双级晶体管的发射极端与数据线相连而作为读出放大器的信号输出端与...
该专利属于日本电气株式会社所有，仅供学习研究参考，未经过日本电气株式会社授权不得商用。

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