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本发明通过两个分频器对时钟信号进行分频处理，处理后的输出信号经过逻辑处理模块及多路选择器进行逻辑处理和选择，使得当分频比为奇数时，得到的时钟信号的占空比为50％。电路结构简单，提高了器件性能，扩大了电路工作的频率范围。的频率范围。的频率范围...
该专利属于无锡有容微电子有限公司所有，仅供学习研究参考，未经过无锡有容微电子有限公司授权不得商用。

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